cadence Virtuoso 618中一些版图绘制的小技巧

1.点击某条金属线查看所有与之连接的金属

2.查看需要连接的所有端口连接关系

用此方法连接完毕之后，一般LVS能够直接通过（可能还会有电源和地的问题，只需把label打好即可）
如图，在箭头处右键选择第一栏

在connectivity中显示了所有未完成的连接关系，当连接错误时，这里也会出现提示，点击下方的线，版图中会给出高亮提示，就不必反复在原理图和版图之间切换了

3.显示所有连线的名称NET

4.设置选择保护，保护后的器件不会被选中

设置成功后黄色线高亮表示对应元件被锁定，后续操作中无法被选择

四 、几个已经完成的SAR ADC项目

4.1、10bit 20MHz SAR ADC（WX:didadidadidida313，备注：CSDN SAR ADC）

10bit SAR ADC 设计，smic18工艺，有工艺库，有效位数ENOB为9.8
常用栅压自举开关Bootstrap，Vcm_Based开关时序，上级板采样差分CDAC阵列，两级动态比较器，比较器高速异步时钟，动态sar逻辑，10位DFF输出，10位理想DAC还原做DFT。
包括详细仿真文档，原理介绍，完整电路图，仿真参数已设好，可直接使用，在自己的电脑上就可以运行仿真。适合入门SAR ADC的拿来练手

4.2、12bit 100MHz Pipelined ADC（WX:didadidadidida313，加我备注：CSDN SAR ADC）

12bit 100MHz pipelined ADC 设计

65nm工艺，电源电压1.2V,ENOB=11.6
结构:
栅压自举开关
CDAC
两级动态比较器
第一级6位SAR ADC
余量放大器
第二级8位SAR ADC
同步和异步SAR logic都有

4.3、李福乐老师8bit SAR ADC（WX:didadidadidida313，备注：CSDN SAR ADC）

清华大学李福乐8bit SAR ADC设计
结构:
分段式电容阵列
经典两级动态比较器

工艺库+电路+设计文档；
工艺库和电路均转成OA版本，可直接导入
送李老师的课件，包含详细设计思路
有matlab代码，FFT，计算ENOB SNDR SFDR SNR THD
适合入门SAR ADC的拿来练手

SAR ADC 详细介绍
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