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RSS订阅原创 摩托罗拉_SPI_总线_协议规范
对于配置为主机的SPI，在之前的传输完成后立即传输排队的数据字节。在从属模式下，如果SS线在连续传输之间没有解除断言，则SPI数据寄存器的内容不传输，而是传输最后接收到的字节。如果主服务器在从服务器处于等待模式时发送了几个字节，从服务器将继续发送与等待模式开始时的操作模式一致的字节(即，如果从服务器当前正在向主服务器发送它的SPIDR，它将继续发送相同的字节)。注意:在双向主模式下，启用模式故障，数据引脚MISO和MOSI都可以被SPI占用，尽管MOSI通常用于双向模式下的传输，而MISO不被SPI使用。
2023-11-24 14:31:29
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原创 SPI driver规范（2）
8.2.1 Spi_ConfigType 8.2.2 Spi_StatusType 8.2.3 Spi_JobResultType 8.2.4 Spi_SeqResultType 8.2.5 Spi_DataType 8.2.6 Spi_NumberOfDataType 8.2.7 Spi_ChannelType 8.2.8 Spi_JobT
2023-11-16 17:11:38
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原创 QSPI底层驱动
1、Spi_Init() 首先是SPI外设模块相关设置初始化。2、Spi_SetupEB（）把相关数据放入相关静态存储区保存。3、Spi_AsyncTransmit（）把数据传输出去。
2023-11-13 16:01:04
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原创 链接脚本语言(LSL)
为了充分利用链接器，您可以编写一个脚本，其中包含有关目标处理器体系结构和定位信息的信息。该脚本的语言称为链接器脚本语言(LSL)。本章首先介绍LSL文件的结构。下一节包含LSL语法的摘要。在其余部分中，将解释链接器脚本语言的语义。TASKING连接器是一个独立于目标的连接器/定位器，它可以同时连接和定位目标板上所有可用内核的所有程序。目标板可能具有任意的复杂性。一个简单的目标板可能包含一个标准处理器和一些执行一个任务的外部存储器。复杂的目标板可能包含多个标准处理器和dsp，并结合FPGA中加载的可配置ip核
2023-11-01 17:35:02
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原创 编程模型（Programming Model）
对于动态加载的代码，或者在没有重定位链接器的情况下从位置无关的片段组装成二进制映像的代码，加载用于pc相关数据寻址的代码地址的适当方法是使用JL(跳转和链接)指令。在结束的情况下，内存访问在循环缓冲区的末尾运行，数据访问也绕到缓冲区的开头。如果代码是静态链接的(嵌入式系统几乎总是这样)，那么代码标签的绝对地址是已知的，可以使用LEA指令(加载有效地址)加载，或者使用一个序列加载扩展的绝对地址。例如，使用加载字指令访问的缓冲区的长度必须是4字节的倍数，使用加载双字指令访问的缓冲区的长度必须是8字节的倍数。
2023-10-31 11:05:56
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原创 体系结构概述
TriCore是第一个针对实时嵌入式系统优化的统一的单核32位微控制器- dsp架构。TriCore指令集架构(ISA)结合了微控制器的实时能力，DSP的计算能力以及RISC加载/存储架构的高性能/价格特征，在一个紧凑的可重新编程核心中。ISA支持统一的32位地址空间，具有可选的虚拟寻址和内存映射I/O。该体系结构允许广泛的实现，范围从标量到超标量，并且能够与不同的系统体系结构进行交互，包括多处理。实现和系统级别的这种灵活性允许在任何时间点在性能和成本之间进行不同的权衡。
2023-10-31 09:58:23
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原创 通用寄存器和系统寄存器
General Purpose Registers (GPRs) Program State Information Registers Stack Management Registers Compatibility Mode Register (COMPAT) Access Control Registers Interrupt Registers Memory Protection Registers Trap Registers Memory Configuration Registers
2023-10-30 11:35:42
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原创 Tasks And Functions
一、Context Types 4.1.1 Context Save Area二、Task Switching Operation 三、 Context Save Areas (CSAs) and Context Lists四、Context Switching with Interrupts and Traps五、Context Switching for Function Calls 六、 Fast Function C
2023-10-29 16:30:44
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原创 Trap System（Trap系统）
trap是由于诸如或等事件而发生的。trap总是活跃的，它们不能通过软件操作禁用。本文描述了可能发生的不同trap和TriCore架构的trap处理机制。
2023-10-29 14:52:33
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原创 Interrupt System（IR中断系统）
在TriCore系统中，多个中断源(如外设或外部中断)可以生成中断请求(如cpu或DMA通道)。本文描述了CPU的中断处理能力，包括中断优先级方案和对向量表的访问。
2023-10-27 17:46:56
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原创 Temporal Protection System（TPS时间保护系统）
TriCore“时间保护系统”用于防止运行时间超时。该系统由两种主要机制组成，即时间保护计时器和异常计时器。
2023-10-27 16:59:53
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原创 Memory Protection System（MPU内存保护系统）
TriCore”保护系统提供了隔离错误的基本功能。该系统不引人注目，开销很小，避免了不确定的运行时行为。保护系统包含硬件机制，保护用户。
2023-10-27 16:12:36
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空空如也
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