mysql 最短路经_FPGA从IBUF到OBUF的最短路经

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本帖最后由 cuizehan 于 2011-3-28 10:42 编辑

想设计一个逻辑，输入信号经过IBUF后，一路送给OBUF输出，一路送给ILOGIC在FPGA内做处理。

IBUF    i_buf( .I(i), .O(branch));

OBUF    o_buf( .I(branch), .O(o));

想让从IBUF到OBUF的延时尽量小，因此把IBUF、OBUF约束在一个IO Tile里(包含两个IBUF、两个OBUF、两个ILOGIC、两个OLOGIC、两个IODELAY)，希望能从IBUF出来后直接就近传给OBUF。

可实际上不是这样，信号经过的路径如下：IBUF -> IODELAY -> ILOGIC -> OLOGIC -> OBUF，下图为FPGA Editor的具体走线。

test_bypass.bmp (567.69 KB, 下载次数:

101)

2011-3-25 22:15 上传

通过后仿确定，从输入引脚到输出引脚的延时为7.359ns。(一个时钟周期2.5ns)

对于从IBUF、OBUF的net加MAXDELAY约束，不管是1ns还是4ns，结果都一样，从输入引脚到输出引脚的延时仍为7.359ns，且时序报告也一样：

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