matlab中sr锁存器,大家一致避免使用的锁存器为什么依然存在于FPGA中？我们对锁存器有什么误解？...

前言

在FPGA的设计中，避免使用锁存器是几乎所有FPGA工程师的共识，Xilinx和Altera也在手册中提示大家要慎用锁存器，除非你明确知道你确实需要一个latch来解决问题。而且目前网上大多数文章都对锁存器有个误解，我们后面会详细说明。

这篇文章，我们包含如下内容：

锁存器、触发器和寄存器的原理和区别，为什么锁存器不好？

什么样的代码会产生锁存器？

为什么锁存器依然存在于FPGA中？

锁存器、触发器和寄存器的原理和区别，为什么锁存器不好？

锁存器、触发器和寄存器它们的英文分别为：Latch、Flip-Flop、Register。我们对这三个单词的翻译真的是非常直观，从名字就能大概猜出它们的含义。

锁存器

什么是锁存器？

锁存器就是用来存储状态信息，就是将这个状态一直保持。锁存器对脉冲的电平敏感，也就是电平触发，在有效的电平下，锁存器处于使能状态，输出随着输入发生变化，此时它不锁存信号，就像一个缓冲器一样；在锁存器没有使能时，则数据被锁住，输入信号不起作用，此时输出一直为锁存的状态信息。我们常见的锁存器有SR锁存器、D锁存器、JK锁存器等。

锁存器的工作过程

我们以最简单的D锁存器为例来说明锁存器的工作过程，D锁存器有3个接口，也可以认为是4个，因为输出的两个Q和\overline{Q}Q只是单纯的反向关系。