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JESD204B实战
文章平均质量分 93
JESD204B
FPGA 学习帝
这个作者很懒,什么都没留下…
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JESD204B实例.v文件学习笔记
JESD204B实例.v文件学习笔记原创 2023-07-31 23:37:39 · 372 阅读 · 0 评论 -
【JESD204系列】七、8B10B编码
8B10B编码旨在使传输链路保持直流平衡,从而精简了时钟恢复电路(CDR)的设计,使集成电路设计成本降低。该编码方式还规定了一些特殊控制符,可提供误码监测功能。8b/10b 编解码模块一般和串化器/解串器连接,组成SerDes 接口。原创 2023-02-28 10:17:08 · 1308 阅读 · 0 评论 -
【JESD204系列】六、加解扰模块的设计原理
扰码模块的目的之一是可以避免频谱尖峰,另一个目的是可使频谱数据独立,使电气接口的频谱选择更有效,避免数据错误。然而,扰码模块的使用会使转换器中所有数字模块会产生一些转换噪声。所以,JESD204B 标准的一些模式不使用扰码模式原创 2023-02-27 15:33:13 · 2415 阅读 · 1 评论 -
【JESD204系列】五、传输层设计原理
传输层的主要功能是根据用户配置的链路参数,对转换器得到的原始样本数据进行映射,从而产生宽度为8bit 的特定格式数据,并视实际应用情景添加控制位或者尾位,以满足格式需求。原创 2023-02-27 11:13:24 · 2150 阅读 · 0 评论 -
【JESD204系列】四、JESD204B实现结构
JESD204B 协议每条链路由一个或多个通道组成,每个通道中都含有用来对齐和同步的信息。通过同步和对齐功能,可以在接收端还原出原本的数据结构。下面将对几种典型的应用配置进行说明。原创 2023-02-27 11:54:27 · 1273 阅读 · 0 评论 -
【JESD204系列】三、JESD204B标准分层
JESD204B 作为一种分层规范,在规范中共定义了四个层,分别为应用层,传输层,数据链路层和物理层。各层分别执行各自的对应的功能,最终通过四个层的联合,将数据高速无误的进行传输。原创 2023-02-19 18:16:03 · 3713 阅读 · 0 评论 -
【JESD204系列】二、JESD204概述
在JESD204B 版本中,引入了确定性延时这一关键同步机制,并根据确定性延迟的不同实现方式划分了三个子类。通过实现确定性延迟,系统在两次上电之间,或者重新建立链路的时候,有了一个可以重复的延迟,为系统在处理来自不同时钟域的数据时提供了可重复的确定性的延迟,极大的方便了设计。原创 2023-02-16 21:29:26 · 2676 阅读 · 0 评论 -
【JESD204系列】一、JESD204总目录
JESD204B系列总目录原创 2023-02-26 19:17:17 · 1355 阅读 · 0 评论