第四章 存储器

基础知识点

  • 主存与缓存之间的数据调动是由硬件(存储器管理部件)自动完成的,主存与辅存之间的数据调动是由硬件和操作系统共同完成的
SRAMDRAD
触发器电容存储电荷
不需要刷新需要定时刷新(2ms)
速 度高、无需刷新集成度,功耗,价格便宜
广泛用于计算机的主存广泛用于高速缓冲存储器
  • RAM —— 为用户编程而设置的
  • ROM —— 一般用于存放系统程序、标准子程序和各类常数
  • 提高访存速度的措施:高速存取芯片、采用cache、调整主存结构(双端口、单体多字、多体并行)
  • 提高主存的可靠性:纠错编码技术
  • 地址映射:主存地址->cache地址
    虚拟地址->物理地址
  • 地址转换:主存地址<-cache地址
    虚拟地址<-物理地址

例题中需要注意的点

例4.1CPU共有16根地址线和8根数据线,并用MREQ作为访存控制信号,WR作为 读/写命令信号(高电平读,低电平写)。设计一个容量为32KB、地址范围为0000H - 7FFFH且采用低位交叉编址的四体并行存储器。要求:

(1) 采用图4.8所列芯片,详细画出CPU和存储芯片的连接图。
图4.8

(2) 指岀图中每个存储芯片的容量及地址范围(用十六进制表示)。
PS这里有需要注意的点是,低位交叉编制的四体并行存储器,所以要将低两位作为片选信号
(1)32 KB四体结构的存储器可由4片8Kx8位存储芯片组成,由于釆用低位交叉编址, 因此需用末两位地址A1、A0控制片选信号,用13根地址线A14 ~ A2与存储芯片的地址线相连。
在这里插入图片描述
(2)根据低位交叉编制的四体存储器的性质,得到各片存储芯片的地址范围:
第 0 片 0,4,…,7FFCH;模4=0
第 1 片 1,5,…,7FFDH;模4=1
第 2 片 2,6,…,7FFEH;模4=2
第 3 片 3,7,…,7FFFH。模4=3

例4.2CPU有20根地址线和16根数据线,并用IO/M作为访存控制信号,RD为读命 令,WR为写命令。CPU可通过BHE和A0来控制按字节或字两种形式访存(如表4.1所示)。要求釆用图4.10所示的芯片,门电路自定。试回答:
表4.1
(1) CPU按字节访问的地址范围是多少?
(2) CPU按字访问的地址范围是多少?
(3) 画出CPU和存储芯片的连接图,要求存储器按字节访问时,需区分奇偶体,且最大 64 KB为系统程序区,与其相邻的64 KB为用户程序区。
(4) 用十六进制写出每片存储芯片所占的地址空间。
图4.10
在这里插入图片描述

PS1.这里需要注意的是题目给出的是CPU的地址线的根数,注意与已知存储器容量时分别按字节、字访问的地址范围的区别
2.在默认情况下,地址线的位数对应的都是按字节编址的(除非数据线<8)

(1)因为已知CPU地址总线为20根,所以按字节寻址时地址范围为:1M
(2) 字长16位,所以当按字访问时,需要除以2,即512K
(3) 由于CPU按字节访存时需区分奇偶体,并且还可以按字访问,因此如果选择64Kx8位 的芯片,按字节访问时体现不出奇偶分体;如果选择32KX16位的芯片,虽然能按字访问,但不能满足以字节为最小单位。故一律选择32Kx8位的存储芯片,其中系统程序区为64 KB,选择两片 32Kx8位ROM,用户程序区为64 KB,选择两片32Kx8位RAM。
该题的难点在于片选逻辑。由于CPU按字访问还是按字节访问受BHE和A0的控制,因此 可用BHE和A。分别控制138译码器的输入端B和A,而A15~ A1与存储芯片的地址线相连,余 下的A16接138的输入端C.
在这里插入图片描述
(4)所用芯片的地址范围:

在这里插入图片描述
ROM1为最大64K的奇地址FFFFFH ~ F0001H,对应数据线D15 ~ D8
ROM2为最大64K的偶地址FFFFEH ~ F0000H,对应数据线D7 ~ D0
RAM1为相邻64K的奇地址EFFFFH ~ E0001H,对应数据线D15 ~ D8
RAM2为相邻64K的偶地址EFFFEH ~ E0000H,对应数据线D7 ~ D0。

例4.3用一个512Kx8位的闪存存储芯片组成一个4MX32位的半导体只读存储器。试 回答:
(1) 该存储器的数据线数是多少?
(2) 该存储器的地址线数是多少?
(3) 共需几片这种存储芯片?
(4) 说明每根地址线的作用。
【解】
(1) 对于4Mx32位的存储器,数据线为32位。
(2) 对于4Mx32位的存储器,按字寻址的范围是4M,按字节寻址的范围是16M,故该存储器 的地址线为24位A23 ~ A0。
(3) 4片512Kx8位的闪存可组成512KX32位的存储器,4Mx32位的存储器共需32片 512Kx8位的闪存。
(4) CPU的24根地址线中,最低2位地址A1A0为字节地址,A20~A2 这19根地址线与闪存 的地址线相连,最髙3位地址A23A22A21可通过3线一8线译码器形成片选信号。每一个片选信 号同时选中4片闪存,以满足32位的数据线要求。

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1. 答:微处理器MPU也常称为微处理机,它是微型计算机的核心部件,微处理器的发展过程就是微型计算机的发展过程。以Intel公司的微处理器为例,微处理器的发展历程经历了以下六代。 1) 第一代微处理器 1971~1973年为4位或低档8位微处理器和微型计算机的时代。这一时期的典型产品是Intel 4004和Intel 8008。第一代微处理器的基本特点是:采用PMOS工艺,集成度低(1200~2000晶体管/片),系统结构和指令都比较简单,仅能进行串行十进制运算,且速度慢,基本指令执行时间为10~20µs,它采用机器语言编程,主要用于家用电器和简单控制场合。 2) 第二代微处理器 1974~1977年为8位中档微处理器和微型计算机时代。这一时期的典型CPU产品有Intel 8080、Intel 8085。 第二代微处理器的显著特点是:采用了NMOS工艺,集成度提高约4倍(5000~9000晶体管/片),时钟频率为2~4MHz,平均指令执行时间为1~2s,速度提高了10~15倍,基本指令执行时间为1~2µs,指令系统较为完善。这一时期推出的微型计算机在系统结构上已具有典型的计算机体系结构以及中断、DMA等控制功能,软件方面除汇编语言外,还可使用如Basic、Fortran等高级语言,在系统设计上考虑了机器兼容性、接口标志化和通用性,且外围配套电路种类齐全、功能完善,因此这种系统广泛应用于电子仪器、现金出纳机和打印机等设备中。 3) 第三代微处理器 1978~1984年为16位微处理器和微型计算机时代。这一时期的CPU产品有Intel 8086、Intel 8088。第三代微处理器的主要特点是:采用了HMOS工艺,时钟频率为5~40MHz,集成度达20 000~70 000晶体管/片,基本指令执行时间为0.5µs,比8位微处理器提高了一个数量级,数据总线宽度为16位,地址线为20位,最大可寻址空间为1MB,具有丰富的指令系统,且CPU的内部结构有很大改进,体系结构与指令更为完善利丰富,采用了多级中断、多种寻址方式、段式寄存器等结构。 4) 第四代微处理器 1985~到1992年为32位微处理器和微型计算机时代。这一时期的典型CPU产品是Intel 80386、Intel 80486。第四代微处理器的主要特点是:大多采用了HMOS或CMOS工艺,集成度每个芯片高达100万个晶体管,基本指令执行速度一般在25Mips,为微型计算机带来了小型机的性能。拥有32条地址线,内存寻址范围为4GB,使用二级存储器管理方式,支持带有存储器保护的虚拟存储机制,虚拟存储空间高达264GB。Intel 80386时钟主频在16MHz以上,80486工作主频提高到了50MHz以上。 5) 第五代微处理器 这一时期的CPU产品有1993年Intel公司推出的Pentium微处理器,使微处理器的技术发展到了一个崭新的阶段,标志着微处理器完成从CISC向RISC时代的过渡, Pentium采用亚微米(0.8µm)CMOS工艺技术,集成度为330万个晶体管/片,内部采用4级超标量结构,数据线64位,地址线36位。工作频率为60/66MHz,处理速度达110Mips。在1994年3月,Intel推出了第二代Pentium,它采用0.6µm工艺和3.3V电源,功耗仅为4W,而且可在不需要时自动关闭浮点单元,散热问题基本得以解决,它的主时钟频率为100MHz和90MHz两种。 6) 第六代微处理器 1995年,Intel公司正式公布的Pentium Pro是一种64位CPU。该处理器采用0.35µm工艺,集成度是550万个晶体管/片,地址线为36位,寻址范围为64GB,其主频提高到133MHz以上,具有两倍Pentium的性能。其余典型产品有称为“具有MMX技术的Pentium和Pentium Pro”,其型号分别为P55C和Pentium Ⅱ, 64位的Pentium III,Pentium 4系列、Pentium D处理器系列、Pentium双核处理器系列和Pentium处理器至尊版系列。

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