0基础UFS自学笔记一

已于 2024-03-14 15:25:48 修改
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分类专栏： 0基础自学UFS协议 文章标签： 笔记 嵌入式硬件
于 2024-03-14 12:19:52 首次发布
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一、UFS InterConnect Layer (UIC)

UFS InterConnect Layer 由物理连接层和数据传输层(链路层) 组成。物理连接层的规范：MIPI M_PHY规范。数据链路层的规范：MIPI UniPro 规范。

1. MIPI M_PHY规范

1.1 定义

物理连接层规范

1.2 PHY

Physical Layer 规范
从从硬件上来说，PUY为物理层的芯片，一般为模数混合电路， 负责接收电、光这类模拟信号，经过解调和A/D转换后通过MII接口将信号交给MAC芯片进行处理。一般MAC芯片为纯数字电路。
PHY定义了数据传送与接受所需要的电流信号、线路状态、时钟基准、数据Encoding和电路等，并向数据链路层设备提供标准接口。

1.3 MIPI

Mobile Industry Processor Interface 移动产业处理器接口，是在移动系统中使用的串行通信协议，专为移动设备（如智能手机、平板电脑、笔记本电脑和混合设备）设计的行业规范的标准定义，被越来越多的应用在各种接口芯片中，例如PCIe总线芯片、存储芯片。MIPI标准定义了三个通用的唯一物理（PHY）层，即MIPID-PHY、C-PHY和M-PHY。

【相关链接】
你必须了解的MIPI

1.4 MIPI M-PHY

UFS M-PHY 是 UFS 存储接口芯片中的物理层模块，为主机和设备在物理层的互连提供通信机制，在 UFS 闪存芯片中的位置如上图所示，物理层 PHY处于整个 UFS 芯片的最底层，其上层依次为Protocol Layer协议层和Application Layer应用层。协议层独立于物理层，通过定义原语函数来实现和上下层的数据对接，避免直接对 PHY 内部进行细节操作。

1.4.1 Why M-PHY？

MIPI M-PHY规范可以为许多applications提供efficient PHY，针对的是特别需要低引脚数，通道可扩展性和功效的应用，规范主要应用在连接摄像机，音频，存储，RF，提供芯片到芯片的处理器间通信。
MIPI M-PHY专为需要快速通信通道以实现高分辨率图像，高视频帧速率和大型显示器或存储器的数据密集型应用而设计。它是一种多功能PHY，为工程师提供配置选择和跨行业平台开发的能力，以有效地解决多个市场。它可以互连智能手机，可穿戴设备，个人电脑甚至大型系统（如汽车）中的组件。

  • 引脚数低
  • 电器规格，适用于光学传输
  • 长距离(m)和短距离(mm)的应用
  • 巨大的速度要求范围：<10Mbps to ~11.5Gbps
  • 时钟灵活性：共享/非共享参考时钟
  • EMI友好型
1.4.2 MIPI物理层规范中的M-PHY包括
  • M-TX状态机
  • M-RX状态机
  • M-PHY的配置流程
  • M-PHY的电器特性
1.4.3 M-PHY 模块接口结构

M-PHY 作为物理层模块，核心作用为收发数据，整个结构分为数据接收端 M-TX 和数据发送端 M-RX 两部分

1.4.3.1 数据接收端 M-TX

M-TX 将来自Protocal Layer协议层的字符数据转化为电平信号，在物理通路（LANE） 上发送给外部设备

1.4.3.2 数据发送端 M-RX

M-RX 的作用则相反，从物理通路上接收电平信号转变成字符数据送给上层协议层

1.4.3.3 M-PHY链路模型

M-PHY 链路LINK模型如图所示
M-PHY Lane Example
物理通路LANE
物理通路LANE是一种单向的、单信号的物理传输通道，用于Host端和Device端的数据传送，由以下三部分组成：

  • M-PHY发送模块M-Tx (M-PORT)
  • M-PHY接收模块M-RX (M-PORT)
  • 差分传输线LINE
    同一方向的LANE表示为一条子链路 SUB-LINK
    LINE 由 M-TX 和 M-RX 之间的点对点互连
    一个M-TX 和 M-RX 分别只有一组差分电平输出或输入接口，对应于每个模块的 2 个 PINs引脚 ：DP 和 DN，其中 DP 和 DN 定义为差分信号的正节点与负节点。
    两个方向相反的 SUB-LINK 加上通路管理单元LANE MANAGEMENT，完成双向数据传输功能 ，称为 链路LINK。
    一个LINE 的接口包含两个 PINs引脚：TXDP 和 TXDN
    在通电互连的情况下，LINE由两根差分布线组成，连接M-TX和M-RX的LINE接口pin。通常，这些电线都是传输线路。一个线路可以包含其他传输介质的转换器，如光纤。为了达到数据传输的目的，这样的线路可以被认为是一个具有端到端信号传输要求的黑盒。此外，对于高级配置功能，支持模块和媒介转换器之间的交互。下图显示了在LINE中使用媒体转换器(MC-TX和MC-RX)的LANE的设置
    在这里插入图片描述
1.4.3.3.1 LANE的基本概念
  1. LINE Definition
    LINE被定义为传到LANE信号的M-TX与M-RX之间的互连。这些信号用于高速和低速数据传输的差分信号。
    M-PHY LANE 是一个M-TX与M-RX之间的单向连接，使用一个LINE作为互连。
    在这里插入图片描述
  2. LINE Status
    协议定义差分线上的状态有DIF-P、DIF-N、DIF-Z、DIF-Q四种：
    DIF-P代表高电平，正差分电压；DIF-N代表低电平，负差分电压；DIF-Z代表零电平，DIF-Q代表未知态。
    DIF-P和DIF-N是由TX端驱动的，所以TX端的输出阻抗是低阻抗；DIF-Z是由RX驱动的，RX端的输出阻抗是中阻抗；而DIF-Q是未知态，TX/RX两端的输出阻抗都为高阻抗。
LINE State NameLINE State Set byVoltageM-TX Output ImpedanceM-RX Input Impedance
DIF-PM-TXPositiveLowAny
DIF-NM-TXNegativeLowAny
DIF-ZM-RXZeroHighMedium
DIF-QNoneUnknown or floatingHighHigh

    对于数据传输，只利用了 DIF-P 和 DIF-N 状态，DIF-Z只在上电和省电状态下发生。
    下图表示LINE在进行数据传输时的带你呀状态：
在这里插入图片描述
      解释上图：
      (1) LINE中传输的差分信号为串行差分传输，所以可以在RX通过示波器看到两条信号（TX同理）
      (2) 上图第一个箭头表示M-PHY当前处于H8或上电状态，rx0p和rx0n电压值可“认为”是0V，实际上rx0p和rx0n电压值在0V上下一定范围内波动，其rx0p-rx0n的差值也在0V上下一定范围内波动。只要这个波动范围是“合理”的，我们都可以认为M-PHY处于DIF-Z状态。
      (3) 第二个箭头时刻点表示LINE处于DIF-N状态，此时rx0p是0V，rx0n是400mV，其rx0p-rx0n的差值即为-400mv。
      (4) 第三个箭头时刻点表示LINE处于DIF-P状态，此时rx0p是400mV，rx0n是0V，其rx0p-rx0n的差值即为400mv。
      (5) 第四个箭头时刻点表示M-PHY处于数据传输阶段，此时LINE状态在DIF-P和DIF-N之间不断跳变，即发送0，1数据。是由TX port 驱动的正差分电压或负差分电压。
      (6) 在LINE上传输的差分信号的电平幅度很小，是mv级别的。所以此时RX接收端需要放大器对接收信号进行放大。
      (7) 同时TX端也支持两种传输信号电平幅度，协议中叫Large Amplitude(LA)和Small Amplitude(SA)，LA电平幅度是SA电平幅度的两倍。实现过程中，TX侧至少实现一种放大模式，当两种放大模式都支持时，默认放大模式为LA。

  1. Signal Amplitude
    M-TX中的LINE驱动器可以支持两种驱动强度，大幅度Large Amplitude(LA)和小幅度Small Amplitude(SA)，从而产生不同的信号幅度。UFS采用大振幅，当上电或者复位之后，每个链路的M-TX就会通过LA进行通信，链路中的子链路保持相同大振幅。
  2. 信号方案
    如图所示，M-PHY被分为两个不同信号编码方案的type:Type-I和Type-Il.
    Type-I：脉冲宽度调制（Pulse Width Modulation，PWM）
    Type-II：不归零信号（Non-Return-to-Zero，NRZ）
    在这里插入图片描述
  3. 传输速率与模式
    M-PHY支持两个主要的传输模式/活动状态:支持3-576Mbps的低速(LS)模式和支持 M-PHY v5.0规范中的1248-23296.0Mbps的高速(HS)模式。每条子链路可以有自己的传输模式,有利于降低链路总功率。高速传输模式被称为“Gears”：M-PHY v5.0规范中Gear1、Gear2、Gear3、Gear4、Gear5。如表所示,每个Gear又被分为速率A和速率B。如果一个MODULE支持高Gear的速率，那么更低的Gear也必须支持，例如支持Gear3的系统也必须支持Gear2和 Gear1,这有利于根据运行时模式的要求改变链路速度,从而进调整性能/功耗比。
    在这里插入图片描述
  4. 状态机
    6.1 Type-I模块的状态机
    Type-I模块的具体功能包括：PWM自时钟LS信令、共享参考时钟操作、LANE内完全嵌入式控制(不需要额外的辅助信号)
    M-TX状态机
    R-TX状态机
    6.2 Type-ii模块的状态机
    Type-ii模块的具体功能包括：系统时钟同步LS信令(SYS)、需要共享参考时钟的可用性、LANE内部分嵌入控制(一些状态转换需要额外的辅助控制信号)
    M-TX
    R-TX
  5. LINE Features
    LINE DELAY：信号通过LINE从M-TX 传输到 M-RX 的时间
    延时在LINE输入端口和LINE输出端口之间进行测量，它在两个引脚处由参考电阻和参考电容器终止；
    外部信号源已连接到LINE输入端口；
    以最大数据速率测试模式CJTPAT(连续抖动模式)。

【相关链接】
MIPI系列之“M-PHY”
你必须了解的MIPI
UFS4.0 协议之M-PHY
LANE的基本概念
M-PHY的信号编码方案

Relative Terms
  • MAC

MAC 是 Media Access Control 的缩写，即媒体访问控制子层协议。该协议位于 OSI 七层协议中数据链路层的下半部分，主要负责控制与连接物理层的物理介质。在发送数据的时候，MAC 协议可以事先判断是否可以发送数据，如果可以发送将给数据加上一些控制信息，最终将数据以及控制信息以规定的格式发送到物理层；在接收数据的时候，MAC 协议首先判断输入的信息是否发生传输错误，如果没有错误，则去掉控制信息发送至 LLC 层。

  • MII

MII即媒体独立接口，也叫介质无关接口。它是IEEE-802.3定义的以太网行业标准。它包括一个数据接口，以及一个MAC和PHY之间的管理接口。数据接口包括分别用于发送器和接收器的两条独立信道。每条信道都有自己的数据、时钟和控制信号。
MII数据接口总共需16个信号。管理接口是个双信号接口：一个是时钟信号，另一个是数据信号。通过管理接口，上层能监视和控制PHY。

  • 差分信号
    传输的是两根信号之间的电平差
Issac神经蛙
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