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11月 09月 08月

原创 verilog 实际开发时应该注意的问题

verilog 实际开发时应该注意的问题

2015-11-21 11:01:58 1508

原创 rom isim仿真

当我们利用ise新建一个ROM的IP核之后，可以新建一个testbench文件用来对这个IP核进行测试，当我们在此修改IP核，但并不关闭isim仿真页面，而直接选择restart按钮，会发现仿真结根跟之前一样，可能是仿真所使用的IP核还是修改之前的那个，所以，为了保证仿真的正确性，我们应该先把仿真的页面关闭，重新打开，这是的仿真结果就跟修改后的IP核相对应了。

2015-11-10 13:58:43 986