stm32时钟最大只能为72M么 还可不可以再倍频，怎么倍频？

最新推荐文章于 2024-03-03 15:43:32 发布
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分类专栏： STM32战舰开发板学习 文章标签： stm32
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1.一般你看到的STM32程序都是用HSE + PLL作为时钟的,因此在程序的一开始调用函数进行了设置,比如RCC_Dein();.... STM32默认就是用内部HSI作为时钟,所以,如果你上电,不对RCC进行任何设置,就是使用内部8M振...

 

2.可将外部8M的晶振换成12M的晶振，还是9倍频，但实际时钟可能达不到理论上的108M，我就是这样用的，如果对时序要求特别高的场合不建议这样使用

 

STM32时钟如果配置超过了72MHZ会如何

我设置的led灯闪烁，HSE是12MHZ，倍频是9，那样不就是108MHZ么，为什么STM32还能正常工作？
求解答~~~

答：这个叫超频， 超频到108Mhz应该还是可以工作的，但是最好还是不要超频 最大可能128MHZ吧，但是会不会始终正常工作就不保证了，对片子也会有损害

ppaiml
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STM32的时钟树结构非常复杂，分频和倍频都是为了生成各种不同频率的时钟信号。其中，分频主要是为了将高频时钟降低到合适的范围，以适应外设和系统的工作要求，同时也可以减少功耗和EMI（电磁干扰）等问题。而倍频则是为了生成高频时钟，以满足高速处理器和外设的需求。 以STM32F4系列为例，其外部时钟源可以选择为HSE（高速外部时钟）或HSI（高速内部时钟），HSE的频率范围为4MHz~26MHz，HSI的频率为16MHz。通过PLL（锁相环）模块，可以将外部时钟频率倍频或分频，生成各种不同频率的时钟信号。具体来说，STM32F4的PLL有两个倍频因子，分别为N和M，其计算公式如下： SYSCLK = (HSE or HSI) * PLLN / PLLM 其中，SYSCLK即为系统时钟，PLLN和PLLM分别为PLL的倍频因子，HSE or HSI为外部时钟源。通过调整PLL的倍频因子，可以生成不同频率的系统时钟信号，以满足不同的工作要求。因此，在STM32中，分频和倍频都是必要的操作。

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