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FPGA与IC开发
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Verilator入门(一)
Verilator可将硬件描述语言Verilog/SystemVerilog编译成优化后的支持多线程的高级语言C++/SystemC模型,通过在高级语言中例化硬件描述语言,进而使用高级语言的特性实现对Verilog/SystemVerilog的验证。简单来说,Verilator对Verilog/SystemVerilog等硬件描述语言添加了一个基于C++/SystemC的wrapper,而后借助C++和Verilator的特定库实现对Verilog/SystemVerilog的高效仿真。原创 2023-06-25 10:48:47 · 2283 阅读 · 3 评论 -
Ubuntu20.04搭建Chisel开发环境
安装java8安装sbt安装IDEA搭建工程原创 2022-03-23 16:25:34 · 1322 阅读 · 0 评论