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转载 pcb封装1

protel99se的封装库1.电阻原理图中常用的名称为RES1-RES4;引脚封装形式:AXIAL系列 从AXIAL-0.3到AXIAL-1.0,后缀数字代表两焊盘的间距,单位为Kmil.2.电容原理图中常用的名称为CAP(无极性电容)、ELECTRO(有极性电容)引脚封装形式:无极性电容为RAD-0.1到RAD-0.4,有极性电容为RB.2/.4到RB.5/1.03.电位器

2015-03-25 22:53:05 3136 1

原创 PCB布线心得

Protel99分五个部分:原理图设计系统;PCB设计系统;自动布线系统;可编程逻辑设计系统;电路仿真系统。一般而言,电路板的最基本的设计分为三步:设计电路原理图;产生网络表;设计PCB。布线要注意的几点:第一,加粗接地线。第二,降接地线构成环路,提高抗噪声能力。第三,将不同模块分开,减少信号耦合干扰。第四,闲置不用的门电路输入端不要悬空。第五,走线用45度折角,禁止用90度,减少高频信号对外的发

2015-03-25 22:40:37 854

转载 Protel常用封装库

sim.ddb元件库各子元件库的类型名称1、74XX.lib74系列数字电路逻辑集成块2、7SEGDISP.LIB七段数码管3、BJT.LIB三极管4、BUFFER.LIB缓冲器5、COMP.LIB放大器6、CMOS.LIB CMOS系列数字电路逻辑集成块7、COMPARATOR.LIB比较器8、CRYSTAL.LIB晶振9、DIODE.LIB二极管10、I

2015-03-25 22:37:36 2036

转载 vmm

引言验证方法学手册即为《Verification Methodology Manual》的直译。  VMM是大规模集成电路(IC)设计验证领域的一种高级验证方法学。  VMM验证方法学主要由ARM和synopsys公司的设计验证领域的专家共同设计,用于开发先进的验证环境。  VMM验证方法学的语言基础是systemverilog语言。它所有的方法学基础都是来自于systemveri

2015-03-21 22:50:33 2349

转载 c与c++区别

【编程辅导班】规划学习路线 + 推荐学习资料 + 自学 + 一对一答疑 + 就业指导C和C++的关系:就像是win98跟winXP的关系。C++是在C的基础上增加了新的理论,玩出了新的花样。所以叫C加加。C和C++的区别:C是一个结构化语言,它的重点在于算法和数据结构。C程序的设计首要考虑的是如何通过一个过程,对输入(或环境条件)进行运算处理得到输出(或实现过程(事务)控制)。

2015-03-21 22:17:11 390

转载 c语言面试题

c语言面试题 最近因为找工作,收集了很多C语言方面方面的面试题以及答案。现在新工作搞定了,决定把这些资料发出来,送给有需要的朋友,免得再象我一样到处搜寻,实在辛苦。发布之前先申明两点:    1 所有资料来自网络(主要是CSDN),本人只是收集和转发。    2 所有问题解答(尤其是代码)只是参考,不保证正确。先发基本问题,再发编程问题..........想成为嵌入式程序员

2015-03-21 22:14:02 617

原创 二进制乘法原理

二进制乘法原理:就是左移(进位)8次,每次最高位为1则加进去,8位移完就得出乘积了实际上和我们做10进制的乘法是一样的,只不过这里的进制是2罢了比如5×6,转成二进制就是0101×0110 十进制乘法大家都会做,公式就是我们他当成十进制101×110来计算下看看 4位乘积=被乘数×千位被+被乘数×百位+被乘数×十位+被乘数×个位既0101×0110=101×0000+101×100+101×10+

2015-03-21 21:29:41 32792 1

原创 寄存器与锁存器的区别

锁存器与寄存器的区别 // 这篇文章之前写的有点问题,最近在做工程的时候同时看了Digital Design Using Digilent FPGA Boards一本老外写的书的时候,对这个问题有了比较彻底的认识。首先应该明确锁存器和触发器也是由与非门之类的东西构成。尤其是锁存器,虽说数字电路定义含有锁存器或触发器的电路叫时序电路,但锁存器有很多组合电路的特性。组合电路就是一个真值表,一个函数,一

2015-03-21 12:10:46 4934

原创 同步信号与异步信号的问题

时钟信号一般为脉冲方波信号,高低电平交错,所以信号存在上升沿与下降沿,同步置零/置位就是在时钟信号上升沿或下降沿时刻出发的信号。异步置零/置位不受CLK(时钟信号)的约束。寄存器的输出信号,有的受CLK约束,就是当输入信号改变时,输出信号不立刻改变,需要等到CLK的触发,寄存器的输出信号才会随着之前输入的改变而变化。区别触发器的同步与异步,要弄清楚计数到条件值时,输出信号是否受CLK的限制。再就是

2015-03-21 10:45:45 5340

转载 Bcd码与二进制区别

BCD码与十进制数的转换关系很直观,相互转换也很简单,将十进制数75.4转换为BCD码:7->0111,5->0101,4->0100所以拼成8421BCD码的结果是:(0111 0101.0100)BCD;若将BCD码1000 0101.0101转换为十进制数:1000->8,0101->5,0101->5所以结果是:(85.5)D。 注意:同一个8位二进制代码表示的数,当认为它表示的是二进制数

2015-03-21 09:45:44 5786

原创 Verilog描述FSM应注意的问题

用一个always块描述FSM电路,也可以根据时序电路的组成框图用两个描述。在时钟的有效沿到来前,可以根据电路 当前状态+输入决定的输出+次态,用一个always块描述。在时钟的有效沿到来时,电路会有当前状态转移到次态,可以用一个时序的always块描述。 可以对第二种方法进行细化,用三个块描述。分别为,输出用一个组合的块描述,次态用一个组合的块描述,电路的状态转化用一个时序的块描述。 I

2015-03-21 08:42:20 1192

转载 ModelSim仿真流程

1、 运行ModelSim,如果上一次使用ModelSim建立过工程,这时候会自动打开上一次所建立的工程;2、 点击File->New->Project,在Project Name中我们输入建立的工程名,在Project Location中输入工程保存的路径,注意ModelSim不能为一个工程自动建立一个目录,这里我们最好是自己在Project Location中输入路径来为工程建立目录,

2015-03-20 22:21:37 1273

Xilinx HDMI ZCU106 HDMI_TX_SS

基于 VIVADO2019.2的带bit/vitis完整工程

2022-06-08

SoC设计方法与实现

适合刚入门的学生看

2017-05-02

步步惊“芯”_软核处理器内部设计分析(第一部分)

由于文件限制在60M内所以分成两个压缩包上传。

2017-03-31

步步惊“芯”_软核处理器内部设计分析(第二部分)

由于文件限制在60M内所以分成两个压缩包上传。

2017-03-31

SystemVerilog 验证方法学

对新一代的验证语言SYSTEM VERILOG进行了详细的介绍,有利于验证工程师进一步提升技能。

2015-10-08

空空如也

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