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原创 quartus II用2个3-8译码器设计五人表决器

需要你用结合真值表分析,我就做简单分析,就是将两个3-8译码器的一个使能端“让”出来当作第4个输入,第4个输入为0时让上面的那个3-8译码器工作这时表示的为。上半部分的卡诺图对应的是4-16译码器,下面的是用一个3-8译码器实现的逻辑(补充上个文章的)本质是一样的,将输出结果分成0到4个人进行讨论(其中只有2人时需要与第五个人进行判断)用两个3-8译码器构成4-16译码器(可以当作4人表决的结果),利用卡诺图化简可较为直观的知道电路逻辑。第4个输入为1时让下面的那个3-8译码器工作这时表示的为。

2024-06-15 09:40:05 648

原创 quartus II9.0 使用D触发器制作一个8进制计数器

使用D触发器和27MHz分频为1Hz后,制作一个8进制计数器

2024-06-08 10:11:49 1170 9

原创 quartus II9.0(DE2)将27MHz时钟信号分频为1Hz(秒表)

主要为27MHz的降频设置

2024-06-08 02:06:14 788 10

原创 quartus II 9.1利用3-8译码器实现5人表决器(图示化工具)

利用3-8译码器实现5人表决器

2024-06-07 10:59:49 994 2

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