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RSS订阅原创 阻抗匹配及其方法
1、阻抗匹配：信号在传输过程中，为避免发生信号反射干扰，要求传输线的特征阻抗与负载阻抗一致；2、基本阻抗匹配原则：单端走线控制阻抗为50Ω，差分走线控制阻抗为100Ω；3、阻抗匹配方法：阻抗匹配四种处理方式_pan0755的博客-CSDN博客_阻抗匹配的方法4、一般串接匹配电阻在阻抗匹配实际应用中最多。...
2022-04-13 13:56:13
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转载 Vivado中单端口和双端口RAM的区别
Note: 以下内容可能会有错误的地方，仅供参考，详细请查阅Xilinx官方产品指南《pg058-blk-mem-gen》 ！BMG即Block Memory Generator，是Xilinx配置BRAM的IP核，可将BRAM配置成如图所示的5种类型。RAM分三种，单端口RAM、伪双端口RAM（Simple Dual）和双端口RAM（True Dual），它们之间的区别是什么呢？先看看它们的接口。可以看到它们的接口区别伪双端口RAM很好理解，相当于读写分开，addra、dina和w
2022-01-06 10:25:22
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原创 AD2019中原理图复制粘贴到word中更清晰设置
1、打开AD，选择菜单栏中的工具2、选择工具下拉菜单中的原理图优先项3、选择Schematic中的General界面，然后取消勾选 使用GDI+渲染文本+
2022-01-04 17:31:40
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原创 控件：label
1、添加控件：工具箱——公共控件——label2、属性1：Name Name属性是代码中该控件的类名。 属性2：Text Text属性是该控件的文本3、Form1的窗体代码Form1.csusing System.Data;using System.Drawing;using System.Linq;using System.Text;using System.Threading.Tasks;using Sys...
2021-12-29 09:45:40
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原创 C#学习笔记（4）
1、dll（库）引用：右键：点击添加引用，再选择需要添加的引用即可。2、新建WinForms窗体引用程序： 1、文件——新建——项目 或直接点击新建项目： 2、Visual C#——Windows窗体应用程序——名称、路径3、项目中窗体Class的区分： 标号 1 的Form类，是用户对窗体控件事件设计的类；标号 2 的Form类，是C#自身与标号 1 的 Form相配合生成的类，无需...
2021-12-28 09:48:44
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原创 C#学习笔记（3）
一、 1、取余 % ：1%2=0； 2、自增 += ：sum +=1; //sum = sum + 1 3、条件选择switch ：switch(state){ case state1 : ...; break; //break 执行后跳出该语句（最近的一层），如果没有break,会顺序执行下一句 case state2 : ...; break; . . .} 4、空...
2021-12-26 09:38:04
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原创 代码笔记（2）
1、递归案例 static long coun(long n) { if (n == 1 || n == 2) return 1; else return coun(n-1) + coun(n-2); } static void Main(string[] args) {
2021-12-23 10:58:54
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原创 C#学习笔记（2）
1、区分大小写（List）和verilog一样，也是区分大小写的，特别是方法名（函数），如list和List是不一样的，List<>，列表，可实现数组功能，<>中为List中的add的数据类型；static void main(string[] args){ var text = new List<int>(); List.Add(1);}2、变量命名规则 必须字母和下划线开头，可用camel(驼峰)规...
2021-12-23 10:56:23
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原创 C#代码笔记（1）
static void Main(string[] args) { Stopwatch 计数器 = new Stopwatch(); //专门用来计算一段程序消耗多少时间 计数器.Start(); string str = string.Empty; //定义一个空的字符串 for (int i = 0; i &l...
2021-12-22 14:46:30
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原创 同一个always块中实现时钟双电平或者双边沿触发信号跳变
always @(*)begin if(!rst_n) sync = 1'b0; else case(state) St_set: begin if(clk_30M) sync = 1'b1; else sync = sync; end 5'd16 : begin...
2021-12-20 10:31:23
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转载 FPGA中的块（block)RAM和分布式（distributed）RAM的区别
块（block)RAM和分布式（distributed)RAM的区别
2021-12-17 10:13:02
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原创 调用RAM IP的注意事项
调用的RAM IP，输出使能，输入地址后，要延迟一个时钟周期，该地址下的数据才会输出，如下图所示： mmodelsim仿真图中7C2为调用RAM的输出地址，一个时钟延迟后，再有上边沿才会触发RAM数据输出；（VIVADO中调用的RAM IP，有时候会出现输出莫名其妙延时两拍的情况，在仿真的时候一定要仔细看，解决办法是删除这个IP，重新调用） 如果在VIVADO中调用RAM IP时，设定默认勾选primitives output register，如下...
2021-12-14 09:39:22
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原创 一个简单的两段式状态机
1、状态转换图：2、verilog代码：`timescale 1ns / 1psmodule Two_st( input clk, //时钟 input rst_n, //低电平复位（一般FPGA都是低电平吧，特别式altera的FPGA） input [11:0] d_in, output reg flag ); parame
2021-12-09 16:51:04
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原创 VIVADO字符设定
VIVADO2020.2文本设定，字体大小、颜色等。（版本不一样，设定方式可能不一样）1、点击菜单栏中TOOLS选项，选择TOOLS子菜单栏中的Settings2、打开Text Editor选项卡，就可以对文本进行特定编辑了。...
2021-12-08 09:25:51
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原创 sysgen与vivado联合开发问题
1、用sysgen生成的IP核名会和simulink的文件名一样，同一个simulink文件生成的不同IP，名字会一样，在VIVADO中就会出现IP被锁的情况，如图所示：所以要注意同一个simulink建模模型生成不同的VIVADO IP核时，simulink的文件名要不一样，否则尽管后面添加的IP核不一样，但还是会覆盖前一个IP核，导致前一个IP被锁住。...
2021-12-07 15:37:14
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原创 在MATLAB中产生高斯白噪声
noise_y=randn(1,N);noise_y=noise_y-mean(noise_y);noise_y=noise_y/std(noise_y);a=0; %a为均值，b为方差，也就是标准差的平方b=sqrt(0.01);noise_y=a+b*noise_y;注：randn(1，N)函数为产生1*N的随机变量矩阵；mean(noise_y)将noise_y的列作为向量处理，...
2021-12-07 15:23:21
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转载 vivado仿真
Verilog的代码编写完成了，代码是否正确，需要经过仿真的验证。打开FreDivDou的工程，仿真点击Sources中的“+”，Add Sources选择添加仿真文件，点击“Next”，Add or Create Simulation Sources点击“Create File”，Create Source FileFile Type选择Verilog，File name填写仿真文件名称，点击OK，...
2021-12-05 19:32:04
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转载 Vivado关联Modelsim进行仿真
Vivado自带的仿真工具Vivado Simulator使用体验不佳，使用当前最流行的Verilog仿真工具Modelsim更加高效便捷。Vivado支持多种第三方仿真工具，包括Modelsim，Questasim等，本文将介绍如何在Vivado中使用Modelsim进行仿真。不同版本的Vivado需要搭配对应版本的modelsim，否则在运行仿真时会报错：WARNING: [Vivado 12-5495] Detected incompatible modelsim simulator inst
2021-12-05 18:59:04
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原创 MATLAB生成ROM用的coe文件
r=ceil(vi*(2^8-1)); %vi为输入信号，量化取整fid = fopen('wave.coe', 'w'); %创建COE文件，文件所存位置和格式fprintf(fid, 'memory_initialization_radix=10;\n'); %采用10进制，一定要主要10后面还要加；fprintf(fid, ...
2021-12-05 15:47:20
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空空如也
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