NXP S32K1 时钟系统

本文详细介绍了NXP S32K1 MCU的时钟系统,包括SCG模块的功能,时钟树结构,以及PCC如何控制各模块时钟。SCG提供了多种时钟源和分频选项,而PCC负责模块的时钟门控和源选择。在时钟切换和模式转换时,需要遵循特定规则以避免问题。
摘要由CSDN通过智能技术生成

概述

本文通过剖析NXP S32K1 时钟分布、SCG、PCC等,加深对MCU时钟系统的了解,避免今后开发在小细节上踩坑。

SCG (System Clock Generator) 模块用以产生设备的大多数时钟,SCG控制系统时钟源(system clocks)、分频(divides)所选时钟到各个时钟域。时钟产生电路(clock generation circuitr)提供几种始终分割和选择,以允许不同模块使用指定的不同频率的市长,也实现了指定时钟门控以允许模块单独失能。
各模块的时钟能够产生自FIRC_CLK,SIRC_CLK, SOSC_CLK, SPLL_CLK或者LPO128K_CLK。此外,模块还可以配置特定的时钟来自其他来源。大多数模块的时钟选择由PCC模块控制。

时钟树

时钟树
S32K14xW才有黄色线条;
S32K11x才有蓝色线条;
S32K11x红色线条。

Clock name Description
PREDIV_SYS_CLK Clocks the QSPI memory in HSRUN80 mode.
CORE_CLK Clocks the Arm core, <=80MHz @RUN, <=112MHz@HSRUN
SYS_CLK Clocks the Crossbar, NVI
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