IC设计基础
主要介绍一些IC设计的基础知识
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IC基础(九):单bit跨时钟域同步
在IC基础(三):跨时钟域处理——电平同步器https://blog.csdn.net/MaoChuangAn/article/details/88814300中介绍了点评同步器,但是其在由快时钟域向慢时钟域传输的时候clk_b有可能采样不到clk_a传输过来的信号。自己看过不少的书,其中对跨时钟域的处理讲的不是很明白,因此抱着试一试的心态在eetop上搜索了跨时钟域。直到看到大神“杰克淡定”讲...原创 2019-05-07 11:40:27 · 3069 阅读 · 3 评论 -
IC基础(八):超前进位加法器
一、概述在前一章中讲述了串行进位加法器,连=了解到了串行进位加法器的进位项的最长延时是限制速度的挂件所在,因此,加法器的进位项可以修改表示成如下:上式中有俩项,每一项都可以使得输出为1。我们定义:(1)生成(Generate)项:(2)传输(Propagate)项:根据生成项和传输项可以直接计算出每一级的进位项,最后根据传播项和进位项来计算求和项。表达式如下:si = Pi^G...原创 2019-04-12 18:26:49 · 10112 阅读 · 0 评论 -
IC基础(六):3x3脉动阵列计算矩阵相乘
本文是在看了一个博客之后才知道怎么做的,就是这个博客FPGA脉动阵列的设计,可惜的是这个博客是转载的,原博客已经找不到了。但是其介绍的还是很详细的,在次基础上我完成了自己的的3*3脉动阵列的设计。本文后面会给出一个PPT文档,也是介绍脉动阵列的,FPGA脉动这列的设计这篇博客似乎也是这个PPT启发的。一、引言引言的大部分内容来自《VLSI数字性信号处理系统:设计与实现》一书。脉动结构(也称脉...原创 2019-04-03 12:06:49 · 10623 阅读 · 29 评论 -
IC基础(五):序列检测器
序列检测器经常出现在笔试题目当中,其实其中的主要思想还是状态机的设计,因此本文也借着序列检测器这一点,讲讲状态机的设计。一、序列检测器要是实现什么功能?序列检测器主要是实现输入的一串序列是否是特定的序列。比如设计一个序列检测器,检测序列“11001”,检测到就输出1,否则输出0。二、设计状态机来检测序列首先要设计状态机,最好是先把状态转换图先画出来,有了状态转换图一切设计就很好办了。根...原创 2019-04-01 18:04:23 · 4456 阅读 · 1 评论 -
IC基础(四):UART异步串口通信
一、什么是UART异步串口通信?首先来解释一下,什么是UART。UART是Universal Asynchronous Receiver/Transmitter的简称,翻译过来开就是通“用异步收发器”。从关键字可以看出来,这是一个异步的通信协议,因为接收和发送使用的不是同一个时钟。另外一个关键字就是串口,串口说白了就是串行。串行通信只是用一根信号线传输数据,每次传输一位,串行传输的特点是线路简...原创 2019-03-27 21:17:29 · 4447 阅读 · 3 评论 -
IC基础(三):跨时钟域处理——电平同步器
一、什么是跨时钟域?在讲怎么解决跨时钟域问题之前,起码的先介绍什么是跨时钟域吧!!!那么跨时钟域指的是什么意思呢?在IC基础(一):异步FIFO的介绍异步FIFO的介绍中其实就存在跨时钟域的问题。跨时钟域简单的说就是两个模块之间运行的时钟频率不一致,并且这里两个模块之间需要通信。举个例子就是现在有两个模块A和B,其运行的时钟分别是CLKA和CLKB。CLKA和CLKB的频率和相位不同的话,一定是...原创 2019-03-26 10:31:59 · 3980 阅读 · 1 评论 -
IC基础(二):同步FIFO
在IC基础(二)中我们已经介绍了异步FIFO,本章介绍的同步FIFO会比上一章简单许多。一、什么是同步FIFO?这部是很简单的问题吗?同步FIFO就是读写时钟域都是同一个时钟的FIFO。也就是说同步FIFO不用考虑跨时钟域的问题。同步FIFO和异步FIFO的根本区别就是读写时钟的不一样。二、同步FIFO的常见参数clk:读写时钟rst_n:同步复位信号w_en:写使能信号r_en:读...原创 2019-03-25 15:30:33 · 4801 阅读 · 2 评论 -
IC基础(一):异步FIFO
今天看别人的博客研究了一天的异步FIFO,中遇到了很多问题。很多人可能有过这样的经历,当你研究一个东西,可能你当时很清楚你是怎么想的,但是过后就忘记了当时的思路了。因此我写博客的主要目的就是为了回头查阅方便。IC基础可能会写很多篇,本篇异步FIFO就是此系列的第一篇。...原创 2019-03-24 22:02:35 · 16086 阅读 · 13 评论