串行加法器/减法器

最新推荐文章于 2023-09-29 22:27:39 发布
钻仰弥坚
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文章标签：硬件工程
本文链接：https://blog.csdn.net/capture3333/article/details/125878727
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一、实验原理

n个1位的全加器（FA）可级联成一个n位的行波进位加法器.M为方式控制输入线，当M=0时，做加法（A＋B）运算；当M=l时，做减法（A-B）运算，在后一种情况下，A-B运算转化成[A] 补+[-B] 补运算，求补过程由B＋1来实现.因此图中是右边的全加器的起始进位输入端被连接到功能方式线M上，做减法时M=l，相当于在加法器的最低位上加1.另外图中左边还表示出单符号位法的溢出检测逻辑:当Cn =Cn-1 时，运算无溢出;而当Cn≠Cn-1 时，运算有溢出，经异或门产生溢出信号.
两个二进制数字Ai , Bi 和一个进位输入Ci 相加,产生一个和输出Si ,以及一个进位输出Ci+1 。
输入			输出
Ai	Bi	Ci	Si	Ci+1
0	0	0	0	0
0	0	1	1	0
0	1	0	1	0
0	1	1	0	1
1	0	0	1	0
1	0	1	0	1
1	1	0	0	1
1	1	1	1	1
根据上表所示的真值表,三个输入端和两个输入端可按如下逻辑方程进行联系：
Si ＝Ai ⊕Bi ⊕Ci
Ci+1 ＝AiBi ＋BiCi ＋AiCi
对一位全加器(FA)来说, Si 的时间延迟为6T(每级异或门延迟3T), Ci+1 的时间延迟为5T,其中T被定义为相应于单级逻辑电路的单位门延迟。T通常采用一个“与非”门或一个“或非”门的时间延迟来作为度量单位。
电路原理图如下：
二、串行可控加/减法器测试

电路初始图：

子电路图：

（1）FA：全加器
示例一：加法
不溢出
1000000000000000+0110000000000000=1110000000000000
可以溢出
1000000000000000+1000000000000000=10000000000000000
示例二：减法：
1110000000000000-1000000000000000=0110000000000000
三、实验代码

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  <lib desc="#Memory" name="4">
    <tool name="ROM">
      <a name="contents">addr/data: 8 8
0
</a>
    </tool>
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    <tool name="Text Tool">
      <a name="text" val=""/>
      <a name="font" val="SansSerif plain 12"/>
      <a name="halign" val="center"/>
      <a name="valign" val="base"/>
    </tool>
  </lib>
  <main name="main"/>
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    <a name="gateUndefined" val="ignore"/>
    <a name="simlimit" val="1000"/>
    <a name="simrand" val="0"/>
  </options>
  <mappings>
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    <tool lib="6" map="Button3" name="Menu Tool"/>
    <tool lib="6" map="Ctrl Button1" name="Menu Tool"/>
  </mappings>
  <toolbar>
    <tool lib="6" name="Poke Tool"/>
    <tool lib="6" name="Edit Tool"/>
    <tool lib="6" name="Text Tool">
      <a name="text" val=""/>
      <a name="font" val="SansSerif plain 12"/>
      <a name="halign" val="center"/>
      <a name="valign" val="base"/>
    </tool>
    <sep/>
    <tool lib="0" name="Pin">
      <a name="tristate" val="false"/>
    </tool>
    <tool lib="0" name="Pin">
      <a name="facing" val="west"/>
      <a name="output" val="true"/>
      <a name="labelloc" val="east"/>
    </tool>
    <tool lib="1" name="NOT Gate"/>
    <tool lib="1" name="AND Gate"/>
    <tool lib="1" name="OR Gate"/>
  </toolbar>
  <circuit name="main">
    <a name="circuit" val="main"/>
    <a name="clabel" val=""/>
    <a name="clabelup" val="east"/>
    <a name="clabelfont" val="SansSerif plain 12"/>
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