Linux下Verilog仿真过程（二）

最新推荐文章于 2024-07-17 20:55:08 发布
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分类专栏： Verilog HDL 文章标签： Verilog
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本文链接：https://blog.csdn.net/cxc19890214/article/details/40711007
版权
本文延续上篇，介绍如何在Linux环境下进行Verilog仿真的图形用户界面操作，包括运行simv文件打开GUI，添加要监视的变量，设置仿真时间及启动运行，以获得更直观的仿真结果和利用其断点执行等高级功能。
摘要由CSDN通过智能技术生成

上一篇Linux下Verilog仿真过程（一）已经介绍了Verilog基本仿真问题

只不过仿真结果输出只是简单输出，不是很形象。

下面看一下“gui(图形用户界面)”的仿真结果。

1》运行生成的simv文件，如下：

出现如下gui界面

2》添加“watch”变量，即添加要监视变量

如图中1，选中要监视的变量，右键-->Add To Watches-->Recent (New View) ,即可将变量添加到监视中。

如下

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