FPGA/cpld设计时遇到的问题

最新推荐文章于 2023-10-10 12:51:45 发布
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分类专栏： FPGA与CPLD
1，Warning: Output pins are stuck at VCC or GND
     解释：这几个输出管脚直接接地了

措施：如果这符合你的设计要求这种警告可以不管

2，Design contains <number> input pin(s) that do not drive logic
     原因:输入引脚没有驱动逻辑(驱动其他引脚),所有的输入引脚需要有输入逻辑

措施:如果这种情况是故意的,无须理会,如果非故意,输入逻辑驱动.

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