本文详细探讨了UVM框架中的关键概念，包括uvm_component与uvm_object的区别、field automation机制、错误退出策略、通信端口、phase机制、objection管理、domain隔离以及sequence操作。讲解了如何设置UVM调试工具，如断点、超时退出，以及sequence的启动、优先级和同步方法，旨在帮助FPGA开发者深入理解UVM测试平台的构建和使用。
1、uvm_component vs uvm_object
上一节调试UVM的时候，有些类继承自uvm_component（env\driver\agent\scoreboard\model等），有些类继承自uvm_object(transaction等)。
uvm_object:几乎所有的类都继承自它
uvm_component:比uvm_object多的特性有：new的时候通过指定parent参数构成UVM树结构；有phase自动执行功能
2、field automation机制
如果不想将某个字段加入则：`uvm_field_int(crc_err, UVM_ALL_ON | UVM_NOPACK)
不会打包crc_err字段，但是调用其他函数print等还是可以显示的
还可以设置其他的，以此类推。
3、设置UVM_ERROR次数后主动退出测试
set_report_max_quit_count(num)；
4、断点
UVM_STOP
set_report_severity_action(UVM_WARNING, UVM_DISPLAY| UVM_STOP);
5、两个component之间的通信
- 提供了port/export/imp端口
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