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原创 FIR 滤波器设计

目录线性相位滤波器与无限持续时间脉冲响应 (IIR) 滤波器相比,具有有限持续时间脉冲响应的数字滤波器(全零或 FIR 滤波器)既有优点又有缺点。FIR 滤波器具有以下主要优点:它们可以具有精确的线性相位 它们始终稳定 设计方法通常是线性的 它们可以在硬件中高效实现滤波器启动瞬态具有有限持续时间。FIR 滤波器的主要缺点是,要达到同样的性能水平,其所需阶数远高于 IIR 滤波器。相应地,这些滤波器的延迟通常比同等性能的 IIR 滤波器大得多。......

2022-07-18 10:00:00 3974 7

转载 xilinx FPGA 固化代码流程

XilinxVIVADO固化流程 纯verilog工程,不涉及SDK代码的固化流程: 综合,实现,生成比特流后,点击Tools—Generate Memory Cinfiguration File… 如图,选择所用FLASH的类型,设置生成mcs文件名,选择生成的比特流文件,文件保存路径自动显示为如图。板子上电,连好JTAG,Open Target后,点击Add Configuration Memory Device如图,...

2022-05-23 09:34:17 1183

转载 MATLAB中readmatrix函数用法

readmatrix函数从文件中读取矩阵。A = readmatrix(filename)A = readmatrix(filename,opts)A = readmatrix(___,Name,Value)说明A = readmatrix(filename)通过从文件中读取列向数据来创建数组。readmatrix函数可自动检测文件的导入参数。readmatrix基于文件的扩展名确定文件格式: .txt、.dat或.csv(适用于带分隔符的文本文件) .x.....

2020-12-25 14:08:25 15100 3

原创 QuartusII安装器件库及遇到的问题解决

最近由于学习soc FPGA,需要Cyclone V的器件,于是就打开自己安装的QuartusII 18.0版本的软件,在器件选择的时候发现没有安装这个器件,于是到Intel FPGA官网去下载器件库,这里给出下载库的地址:器件库下载地址:https://fpgasoftware.intel.com/?edition=standard打开网址之后可以根据自己的需求下载需要的所需要的器件库文件,下载器件库文件的时候一定清楚自己安装的是什么类型版本以及版本的QuartusII软件,如图示所示: ..

2020-07-03 10:53:13 19889 6

原创 Matlab中lsim函数使用

lsim函数:lsim函数是针对线性时不变模型,给定任意输入,得到任意输出。lsim函数表示任意输入函数的响应,连续系统对任意输入函数的响应可以利用lsim函数求取。语法(常用):1.分子分母形式lsim(num,den,u,t)2.传递函数形式lsim(sys,u,t)3.状态空间形式lsim(A,B,C,D,u,t)其中,u为由给定输入序列构成的矩阵,它的每列对应一个输入,每行对应一个新的时间点,其行数与时间t的长度相等,其它的用法与step函数相同。...

2020-05-22 15:16:32 61342

原创 自学Python技术的方法

学习Python技术可以通过以下步骤进行:了解基本概念:开始学习Python之前,可以先了解一些基本概念,例如变量、数据类型、条件语句、循环和函数等。这些基础知识将帮助你更好地理解和编写Python代码。学习语法和语言特性:Python有自己独特的语法和语言特性,比如缩进和代码块的使用。通过阅读官方文档、教程或参考书籍,你可以学习Python的语法规则,并掌握如何使用Python提供的各种功能和特性。练习编程:编程是学习Python的关键部分。

2023-06-08 14:09:32 116

转载 信号通过电容后的影响

从公式中可以看出,通过电容的电流迅速升高,然后按照上述公式,程倒指数下降,而下降的速度和指数的幂有关,幂越大,下降的越快,而当幂当中的τ,也就是RC的值越小时,电容电流下降的越快,相反,当RC,也就是电容的值越大时,电容电流下降的越慢,如上图,当电容达到50nF时,几乎能保持相当的时间了,足够满足100Mhz以上的信号了。当然电容不是越大越好的原因之二,就是电容大了之后封装也会大,从而PCB的焊盘也会大,这对信号的阻抗会造成较大影响,甚至会引起谐振,关于电容焊盘以及电容位置的影响,我们下期文章介绍。

2023-06-08 08:43:28 17

原创 Simulink仿真模块 - Waveform Generator

名称-值语法 - 指定可选的、以逗号分隔的 Name,Value 对组参数。Name 为参数名称,Value 为对应的值。可采用任意顺序指定多个名称-值对组参数,如 Name1,Value1,...,NameN,ValueN。Waveform Generator 模块一次输出一个信号。Waveform Generator模块的功能是使用信号符号输出波形。此模块支持普通、快速和快速加速模式以及快速重启。模块将空字符向量或空白字符向量解释为接地。表中输入信号符号,每行一个波形定义。表中输入的信号符号输出波形。

2023-06-07 08:49:59 166

转载 关于伺服电机的控制模式及增益调整

位置环的输入就是外部的脉冲(通常情况下,直接写数据到驱动器地址的伺服例外),外部的脉冲经过平滑滤波处理和电子齿轮计算后作为“位置环的设定”,设定和来自编码器反馈的脉冲信号经过偏差计数器的计算后的数值在经过位置环的 PID 调节(比例增益调节,无积分微分环节)后输出和位置给定的前馈信号的合值就构成了上面讲的速度环的给定。位置环增益,提高位置响应的速度,也就是说找到位置的快慢,增益越高达到目标的时间越短,不是速度的关系,闭环系统在最后定位结束的地方是个高速震荡的过程,在目标值附近快速震荡,最后找到目标。

2023-06-07 08:43:22 27

转载 PLC对模拟量信号,是怎么进行处理的?

从以上内容知道,从PLC直接读取到的模拟量信号为整型数据,整型数据无法直观的反馈出实际的物理量大小,故为了能够直观的反馈出现场的过程信号情况,还应该将这些整型数据转换为反馈直观真实的浮点数信号。系统中的过程信号通过变送器,将这些检测信号转换为统一的电压、电流信号,并将这些信号实时的传送至控制器(PLC)。3、PLC同一个模块对不同类型的模拟量信号的转换范围是一致的(如西门子对±10 V、±5 V、±2.5 V 或 0 到 20mA的模拟量信号的转换范围均为-27,648 到 27,648);

2023-06-06 10:13:39 46

转载 运放的中间级和输出级

由于R1和R2之间是导线所以UB1=UB2.PNP要求e端电位大于b端.所以Q2处于截止状态.交流时,当正半周时,Q1导通,Q2的Ube反偏的更大,截止.所以经由Q1放大输出正半周信号.由于Q1,Q2参数相同,且经由Q2c端接地.所以射极输出位置的电位=Vcc/2也就是说每个三极管的集电极电位=vcc/2.添加的R4,D1,D2的作用是静态时Ub2。正半周时Q1导通,Q2截止.如上面所述.负半周,Q1截止,Q2导通.由于C2在正半周充电,此时开始放电,C2左端为+,右端为-,输出负半周信号.

2023-06-05 08:47:35 52

原创 Simulink仿真模块 - Signal Conversion

目录说明实例创建总线信号的连续副本​将虚拟总线转换为非虚拟总线​将非虚拟总线转换为虚拟总线将Muxed信号转换为矢量模块特性Signal Conversion:将信号转换为新类型,而不改变信号值在仿真库中的位置为: Simulink / Signal Attributes HDL Coder / Signal Attributes 模型为:说明Signal Conversion模块可将信号从一种类型转换为另一种类型。要选择要...

2023-06-02 17:27:00 588

转载 奇妙的傅里叶变换,原来是这样子滴!

f(t)是t的周期函数,如果t满足狄里赫莱条件:在一个以2T为周期内f(X)连续或只有有限个第一类间断点,附f(x)单调或可划分成有限个单调区间,则F(x)以2T为周期的傅里叶级数收敛,和函数S(x)也是以2T为周期的周期函数,且在这些间断点上,函数是有限值;所以,有时候分析一个信号,我们可以用频谱分析仪去看它的频谱,也可以用示波器去看它的波形一样。

2023-06-02 08:51:12 85

转载 buck芯片,上电瞬间波形震荡,如何解决?

但此时我们发现此芯片的使能引脚一直到时刻B都是使能的,因此输出被再次使能,输出电压被尝试再次拉高,但因为这时候输入电压的进一步下降导致输出已经无法满足负载的消耗,因此输出电压只能在正常输出与低电位之间不断开关,即图 1、图2所展示的波形。同事在测上下电的时候,发现输出电压在上下电会出现震荡的现象,如图4所示,放大后观察发现,上电时刻震荡发生时,EN使能引脚满足芯片启动要求,但是这时输入电压仍较低,导致芯片打开后就立即被后端负载拉低,周而复始,直到使能引脚和输入电压同时满足芯片工作设计电路要求时震荡才消失。

2023-06-01 09:22:35 86

转载 为什么会有0欧电阻?

地是参考0电位,所有电压都是参考地得出的,地的标准要一致,故各种地应短接在一起。而随着时间推移,大规模工业生产中越来越多的利用到贴片元器件,这也使得生产贴片单面电路板的时候遇到了同样的问题,飞线将很难焊接到贴片的焊盘里,这时候采用0欧电阻可以在较细的线路上“飞跃”过去,减少设计的难度。还有就是不同尺寸0欧电阻允许通过电流不同,一般0603的1A,0805的2A,所以不同电流会选用不同尺寸的还有就是为磁珠、电感等预留位置时,得根据磁珠、电感的大小还做封装,所以0603、0805等不同尺寸的都有了。

2023-05-29 09:27:16 130

转载 最常见的电阻上下拉,你真的吃透了?

在我们设计电路的时候,并不是一个芯片的所有信号都会被用到,这些未使用的输入信号也应该连接在一起或分别连接对应的上/下拉电阻,这些未使用的输入不应该只是浮动。

2023-05-28 22:18:44 142

转载 MOS驱动好不好,波形一看就知道

由于MOS管的制作工艺,决定了本身GS之间有结电容以及GD之间有弥勒电容,DS也有寄生电容,这使得MOS管的驱动变得不那么简单。波形的上升沿和下降沿非常缓慢,甚至可能近似三角波,可尝试将栅极驱动电阻减小,如果变化不大,很可能是驱动芯片的驱动能力不足引起。一般认为MOS管是电压驱动型,所以驱动MOS管,只需要提供一定的电压,不需要提供电流。肉眼可见这也是方波,上升沿和下降沿都比较陡峭,开关速度比较快,管子损耗小,只是管子有略微的震荡。一般认为三极管是电流驱动型,所以驱动三极管,要在基极提供一定的电流。

2023-05-27 09:43:43 156

转载 为FPGA设计添加复位功能的注意事项

本文将探讨在 FPGA 设计中添加复位输入的一些后果。本文将回顾使用复位输入对给定功能进行编码的一些基本注意事项。设计人员可能会忽略使用复位输入的后果,但不正确的复位策略很容易造成重罚。复位功能会对 FPGA 设计的速度、面积和功耗产生不利影响。在继续我们的讨论之前,有必要强调一个基本原则:FPGA 是可编程设备,但这并不意味着我们可以对FPGA 中的每个功能进行编程。这一基本原则将在本文的其余部分进一步阐明。

2023-05-26 11:02:42 147

转载 四种最简单的防反接电路

工作原理是当电源正常接入是,MOSFET导通,当电源反接后,MOSFET截止,达到反接保护效果。当电源正常接入时,二极管不工作,电流通过熔断器流入电路,当电源反接后,二极管瞬间导通,电源正负极近似短路。所以无论正反接,电路都可以工作,但是,有优点就会有缺点,在工作过程中,全桥整流器上会产生1.5V左右的电压降。对供电电压有严格要求的电路,就不推荐使用,0.7V的电压降可能会导致电路不工作。单个二极管串联到电源输入端,防反接电路原理是利用二极管的单向导电性,正向导通,反向截止。废话不多说,直接上干货!

2023-05-24 21:11:13 157

转载 DC/DC变换器设计中的常见错误及解决方案

我们在测量环路的波特图时,是从输出电压上面,注入一个交流的小信号,通常来说这个信号是远远小于我们的输出电压,如果注入信号太大的话,它就会影响我们电路的一个正常工作,有可能导致开关波形出现,上面所示的一个丢波现象,此时得到的波特图是没有任何意义的。电路软启动的时间的确定,主要取决于采用较少输出电容,就可以减小电路的冲击电流,为了正常启动,我们必须避免冲击电流过大,触发过流保护,或者导致输出电压出现明显的下跌,其次,如果是多级电路,要按照一定的秩序去启动各路输出,来避免同样的问题。那如何设置注入信号的大小呢?

2023-05-22 19:25:29 155

转载 单片机中常用的轻量级校验算法

通过MD5算法进行加密,文件就可以获得一个唯一的MD5值,这个值是独一无二的,就像我们的指纹一样,因此我们就可以通过文件的MD5值来确定文件是否正确,密码进行加密后也会生成MD5值,论坛就是通过MD5值来验证用户的密码是否正确的。CRC有多种变体,比如:CRC-1、 CRC-5-USB、 CRC-8、 CRC-16、 CRC-32、 CRC-64等。循环冗余检查(CRC)是一种数据传输检错功能,对数据进行多项式计算,并将得到的结果附在帧的后面,接收设备也执行类似的算法,以保证数据传输的正确性和完整性。

2023-05-19 10:00:00 151

原创 我的创作纪念日

我喜欢在技术社区、博客平台或论坛上发布我的文章,与其他人分享我的观点,并接受他们的反馈和建议。我发现,通过创作,我可以将自己的想法和见解传达给更广泛的受众,并与其他创作者和读者进行交流和互动。这些技能和经验对我的工作和学习都有着直接的影响,使我能够更好地与他人沟通、展示自己的观点,并推动自己在职场和学术领域的发展。创作给予我粉丝的关注、正向的反馈、阅读量的增长以及与志同道合的领域同行的交流和认识。这种交流和互动不仅加深了我的专业知识,也扩大了我的人脉圈子,为我提供了更多学习和合作的机会。

2023-05-19 09:22:23 648 2

转载 set_input_delay中-add_delay的作用

在默认情况下,一个port只需要一个min和max的dealy值,如果我们设置两次,那么第二次设置的值会覆盖第一次的值:下面的第一行就无效了。但其实,第一行也是无效的,因此2.5比2.1要大,如果满足2.5了,那一定满足2.1。参数,那么第二条会覆盖第一条约束,那么上升沿的约束就没有了。但有时也会在后面增加一个。

2023-05-19 08:49:43 164

转载 3个原因告诉你,为什么CAN比RS-485更好?

RS-485和CAN都是串行通信协议。它们允许在单个系统中布置多点设备,大大缩短了电缆长度,差分设计适用于强干扰的环境,两者都使用120 Ω电阻端接,并配有内部过压电路以进行故障保护。RS-485和CAN有太多的共同点,但无疑是不一样的。RS-485更多的是应用在工业领域,CAN被广泛设计用于汽车行业。但现在,不仅汽车行业广泛使用CAN,而且航空航天等其他行业也开始转向CAN。但是要了解使这些协议与众不同的差异,我们必须知道它们到底是什么。先简要介绍一下RS-485。

2023-05-17 10:00:00 160

转载 vivado中IP核的Core Container特性

如果只想打包单个IP核,在Sources窗口的IP Sources标签下,在对应IP核的右键菜单中,选择“Enable/Disable Core Container”,来启用或禁用Core Container功能,如下图所示。在Vivado中生成 IP核时,一般默认是对应的IP核文件夹会生成在工程目录的.srcs/sources_1/ip路径下。在项目Settings中的IP标签下,选中“Use Core Containers for IP”(默认为不选),这样工程中的所有IP核都会被打包为XCIX格式。

2023-05-15 08:40:47 150

转载 Vivado自定义IP核

在Vivado中,IP核包含可配置、可生成和可定制的模块,通过IP Integrator工具集成到设计中,简化了硬件设计流程。使用Vivado提供的IP核可以减少设计时间和成本,但是并不是所有的需求都能够满足,有时候需要设计自定义的IP核以实现特定功能或加速系统性能。使用自定义IP和xilinx官方IP的方法一样,但如果在其他的工程里面使用封装好的ip核,还需要将ip核文件添加到ip核库里面。Review and Packaga 可看到IP核的信息,点击 "Package IP" ,ip核已经封装完成。

2023-05-14 19:42:53 154

转载 verilog数据类型和数组

Verilog-2001 标准引入了signed 和 unsigned关键字,在Verilog-2001标准发布之前,所有net类型和variable类型都只能用于存储无符号(Unsigned)数据类型。verilog 中最常用的net类型就是wire类型。representation:进制, b或B表示2进制,o或O表示8进制,d或D表示10进制,h或H表示16进制,可省略,则默认是十进制。verilog中最常用的变量类型是reg类型,用于always语句块内,如下面的代码片段所示,实现了一个D触发器。

2023-05-12 10:59:04 165

转载 vivado HDL编写示例

根据移位寄存器的长度不同,在综合时会选择采用一个 SRL 类型原语,或采用级联的 SRLC 类型原语进行实现。报告检测出的锁存器(Latches),这些锁存器是由组合逻辑HDL代码设计错误引起的,比如if或case状态不完整。寄存器是一种广泛使用的存储器件,可以在时序逻辑中存储多个比特位,通常由触发器或D触发器等逻辑单元实现。Vivado综合时会根据实际情况,确定是用LUT实现,还是用DSP实现,建议使用乘法时,计算结果输出多打两拍,有助于改善时序。常见的触发器有D触发器、JK触发器、T触发器等。

2023-05-08 08:38:59 192 2

翻译 信号的两种表现形式-时域和频域

级数中的每一个分量,在频域都对应一个迪拉克脉冲,它是频域中的一个离散分量。可以看出,正弦和余弦信号的频谱都由狄拉克脉冲组成,而且他们的傅里叶变换在幅度上是相同的,因此这两个信号在同一频率处表现出相同的幅度谱。根据傅里叶定理,任何时间域中的周期性信号都可以分解为不同频率和振幅的正弦/余弦信号的总和。非周期信号的频谱可以通过傅里叶变换来计算,其频谱不是由离散频谱分量组成的。这两种显示模式之间的关系,如下图所示,可以通过一个简单的正弦信号显示出来。所以时域中的每一个信号都在频域中对应相应的频谱。

2023-05-07 10:00:00 195

转载 C语言进阶之 回调函数详解

如上述代码:可以看到,Handle() 函数里面的参数是一个指针,在 main() 函数里调用 Handle() 函数的时候,给它传入了函数 Callback_1()/Callback_2()/Callback_3() 的函数名,这时候的函数名就是对应函数的指针,也就是说,回调函数其实就是函数指针的一种用法。结合这幅图和上面对回调函数的解释,我们可以发现,要实现回调函数,最关键的一点就是要将函数的指针传递给一个函数(上图中是库函数),然后这个函数就可以通过这个指针来调用回调函数了。

2023-05-05 10:55:32 135

原创 C基础学习之C 输入 & 输出

当我们提到时,这意味着要向程序填充一些数据。输入可以是以文件的形式或从命令行中进行。C 语言提供了一系列内置的函数来读取给定的输入,并根据需要填充到程序中。当我们提到时,这意味着要在屏幕上、打印机上或任意文件中显示一些数据。C 语言提供了一系列内置的函数来输出数据到计算机屏幕上和保存数据到文本文件或二进制文件中。

2023-05-02 10:00:00 764

原创 C基础学习之C 从函数返回指针

在上一章中,我们已经了解了 C 语言中如何从函数返回数组,类似地,C 允许从函数返回指针。另外,C 语言不支持在调用函数时返回局部变量的地址,除非定义局部变量为。

2023-04-30 10:00:00 99

原创 C基础学习之C 传递指针给函数

C 语言允许您传递指针给函数,只需要简单地声明函数参数为指针类型即可。

2023-04-29 10:00:00 97

原创 深度学习中关于图像分类的设计

一个典型的深度学习项目是图像分类。图像分类是指将图像分为不同的类别,比如识别一张猫的图片和一张狗的图片。以下是一个简单的图像分类项目的实现过程:数据收集和准备:收集图像数据集,将数据集分为训练集和测试集,进行数据预处理,包括图像缩放、数据增强等操作。模型选择和设计:根据任务的特点选择适合的深度学习模型,比如卷积神经网络(CNN)。设计网络结构,包括卷积层、池化层、全连接层等。模型训练:使用训练数据集对模型进行训练,通过反向传播算法不断更新模型参数,使得模型能够逐渐学习到特征并提高分类准确率。

2023-04-24 20:07:42 915

原创 IT行业技术知识分享说明

人工智能和机器学习: 人工智能和机器学习的应用广泛,包括自然语言处理、图像和音频识别、智能推荐系统、自动驾驶、金融预测等。物联网和物联网安全: 物联网技术将各种设备和传感器连接到互联网上,实现了设备之间的互联互通,为企业提供了更多的数据和洞察。随着云原生技术的兴起,开发者可以更好地利用云计算提供的弹性和可伸缩性,实现更高效的应用开发和部署。总的来说,深度学习项目的实现过程包括数据收集和预处理、模型设计和训练、模型优化和调试、模型部署和应用等环节,需要综合考虑多方面因素,以实现高效、准确的图像分类任务。

2023-04-24 19:58:14 432

转载 Vivado:ROM和RAM的verilog代码实现

RAM设计方式有很多,可以用BRAM、LUT、分布式RAM、URAM实现,可以使用RAM_STYLE属性强制规定使用的资料类型。(*rom_style = "distributed" *)表示用分布式 RAM实现。No-Change模式:新内容载入时,不读取该地址的内容(即维持之前的值不变);(*rom_style = "block" *)表示用Block RAM实现。(*rom_style = "uram" *)表示用uram实现。(*rom_style = "reg" *)表示用寄存器实现。

2023-04-24 14:46:53 142

原创 Simulink仿真封装中的参数个对话框设置

提供文字或 HTML 文本. 如果帮助字段的第一行不是 URL,或者 web 或 eval 命令,Simulink 将在 MATLAB Online Help 浏览器中的某个标题下显示该文本,该标题是封装类型字段的值。为了更加直观和清晰的分析仿真,会将多个元件实现的一个功能封装在一起,通过参数对话框窗格,可以使用参数、显示和动作选项板中的对话框控制设计封装对话框。Simulink 使用在封装对话框中键入的封装参数值,或者,它也可以计算指定的内容并将其用作计算结果。允许为选定的对话框控件类型指定工具提示。

2023-04-18 16:11:22 459

转载 verilog编程艺术(提升代码灵活性)

Verilog中的generate语句可以生成重复结构的代码块,例如模块实例、寄存器或电路组件等等,在设计大型系统时非常有用,可提高写代码效率。localparam用于模块内部定义常量,特别是模块名已定义了parameter属性时,模块内部使用常量,需要用localparam来定义。Verilog中的function语句是用来定义函数的,通常用于执行一些重复的操作,例如计算逻辑等等。casez语句中,如果分支表达式某些位的值为高阻z,那么就忽略这些位的比较,而只关注其他位的比较结果。

2023-04-17 10:32:32 80

转载 verilog的阻塞赋值和非阻塞赋值“轻松掌握”

其实阻塞赋值和非阻塞赋值理解起来很简单。大家只需要always@(posedge clk)块中使用非阻塞赋值”

2023-04-10 08:00:00 94

转载 FPGA学习网站、开源网站和论坛网站汇总

HDLBits有一系列的 Verilog 基础知识,可以在线仿真的学习网站,题目很多,内容丰富,包括了 Verilog 的基础语法、时序电路和组合电路、基础电路和测试激励等等。牛客网是一个综合类刷题网站,包含了Verilog基础题、进阶题和面试题,题目挺丰富,可以在线仿真和对比结果。现在很多做开发板的公司都开源了部分开发板的教程和源代码,不管有没有买开发板,大家可以下载下来,学习和参考都行。米联客做开发板的,专业开发论坛,开源了学习资料和代码,可以学习和参考。数字IC论坛,里面有FPGA开发类板块。

2023-04-08 10:00:00 95

SystemVerilog验证说明

主要是SystemVerilog验证说明文档,有需要的可以自行下载看看。

2023-03-31

ZYNQ PL SFP 光口通信例

本文主要介绍说明 XQ6657Z35-EVM 高速数据处理评估板 SPF 光口通信例程的功能、使 用步骤以及各个例程的运行效果。

2023-03-21

DE1-SoC-User-manual-ref

学习DE1-SOC FPGA的资料,有需要的可以下载看看。

2023-01-29

XILINX-时序约束使用指南中文

XILINX_时序约束使用指南中文

2023-01-05

伺服电机控制代码,有需要的可以下载看看

伺服电机控制参考代码,可以学习一下。

2022-11-09

Verilog Testbench设计技巧和策略.zip

仿真文档。

2021-08-28

Modelsim仿真技巧文档.zip

FPGA仿真技巧文档。

2021-08-28

电机控制学习笔记.zip

电机控制学习的文档

2021-08-27

zdxhclysjfx.zip

振动信号的处理文档

2021-08-26

自动调节系统解析与PID整定.zip

讲述PID控制的一些方法和自调整技术

2021-08-21

PMSM_System.zip

PMSM_System.zip

2021-06-21

srqcwzfpga.zip

FPGA学习文档资料

2021-02-20

alien_invasion_python.7z

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2021-01-14

观测器的运用.pdf

George Ellis大神的另外一本著作Observers in Control System - A Practical Guide-George Ellis,主要是将观测器的,有需要的可以下载看看。

2020-12-17

FPGA学习资料.pdf

FPGA基础学习资料,介绍关于FPGA的组成,FPGA仿真的内容,对入门学习FPGA的有很好的帮助。

2020-06-11

ifft_sim.rar

ifft变换,同时使用了fft变换,使用Verilog语言实现,比较实用的变换。

2019-07-09

BM3D图像去噪算法

BM3D三维块匹配算法,对于学习图像处理有比较号的效果

2016-06-16

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