TimingDesigner使用——简介

本教程详述了TimingDesigner V9.25的使用,涵盖创建时序图、参数和库电子表格的运用、接口分析及高级时序分析等。用户将通过一系列实验学习如何进行接口规范、时序约束设定、衍生信号和时钟模拟,以及信号完整性和FPGA时序集成的分析。
摘要由CSDN通过智能技术生成
  1. 简介
    1. 概述

本手册是对TimingDesigner Version 9.25 Quick Start Training Guide 的补充,并且使用TimingDesigner User’s Guide 作为参考教程。通过本次培训,用户将能更好的使用TimingDesigner。

本教程包含几个实验,每个实验有一些关于工具使用的详细描述。这些实验讲授使用TD创建一个时序图,也讲了超出教程范围的高级分析。

本手册默认用户已经安装好了TD V9.25软件。

 

    1. 内容

TD创建的时序图有很多用途,如掌握接口规范,沟通设计需求,发布组件规范和分析组件或者模块之间的接口时序。本册培训分成几个实验来突出这些目的。

 

实验1 – 创建时序图和接口协议规范

涉及到创建时序图和接口规范的基本步骤。用户将建立一个时钟,一些信号,添加信号沿,添加延迟,以及建立时间和保持时间的约束条件。

 

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