JPEG XS的FPGA实现

最新推荐文章于 2024-07-27 14:54:16 发布
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FPGA实现流程如下

1.编码预处理：上采样，去直流

2.变换：可选择RGB转YUV，使用5/3小波变换，最高支持水平5层分解和垂直2层分解。从源码看出官方曾经也试过13/7小波变换。我实际上板比较效果没有肉眼可见的提升。想来应该是使用了定点的13/7变换，导致效果一般。

3.量化：量化可选择均匀量化和死区量化，我使用的是均匀量化，因为据我分析均匀量化效果简单且效果更好

4：熵编码：分成4部分进行熵编码，分别是sigf,gcli,data,sign

最终资源占用如下

器件

Slice LUT

Slice Reg

DSP

BRAM(36k)

速度

XC7A100T-2

36.5K

28K

2

71.5

145M

XC7K160T-2

38.7K

28K

2

71.5

220M

XCZU9EG-2

36.8K

27.8K

2

71.5

310M

鼠道行
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m0400220334的专栏
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VS2021的专栏
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JPEG XS 的FPGA实现
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XS是一种新型的无损压缩技术，它可以在保证图像质量的同时，大幅度减小图像数据的大小。目前，已经有一些公司开始研发JPEG XS的FPGA实现。其中，Xilinx公司的FPGA平台是目前最为流行的一种平台。在实现JPEG XS的FPGA加速器时，需要考虑到以下几个方面： 1. 需要对JPEG XS的压缩算法进行硬件实现，以提高压缩速度和效率。 2. 需要对JPEG XS的解压算法进行硬件实现，以提高解压速度和效率。 3. 需要考虑到FPGA的资源限制，对硬件实现进行优化，以提高FPGA的利用率。 4. 需要考虑到FPGA的接口和通信协议，以便与其他系统进行数据交换和通信。
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