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芯片后端
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【转载】[ZZ]slew和skew
而clock jitter,是指因为晶体自身的稳定性,温度和电源等原因,造成的时钟的频率变化,这种变化又可细分为:Period Jitter,Cycle to Cycle Period Jitter,Long Term Jitter,Phase Jitter,Time Interval Error (TIE)等,也有器件厂家用相位噪声来描述时钟jitter。slew在英文里有急转弯的意思,顾名思义,这里肯定是指一种状态的变化,所以,slew rate中文一般翻译成,压摆率,指的是电压上升的速度。原创 2023-06-27 13:44:15 · 483 阅读 · 0 评论 -
岁月的脚步,被时间冲刷——如何修复EM ?
今天给大家介绍一下另一类signoff阶段需要修复的Violation——EM violation。首先,我们也还是来了解下EM violation的概念。EM全称electro-migration,电子迁移。当电子流过金属层时,会与金属层中的原子发生碰撞,碰撞导致金属的电阻增大,并且会发热。在一定时间内如果有大量的电子同金属原子发生碰撞,金属原子就会沿着电子的方向进行流动。导致金属连线断裂,这种现象我们称之为EM电迁移现象。那在我们后端布局布线中,EM一般产生的原因有以下几种:1)金属线太长2)f转载 2021-04-28 17:23:01 · 1592 阅读 · 0 评论 -
[转载] Abstract提取LEF说明
链接: Abstract提取LEF说明.原创 2021-04-23 12:15:58 · 3400 阅读 · 0 评论 -
[转载]后端基础问题各种data的作用。
复制别人的东西GDSII:它是用来描述掩模几何图形的标准,是二进制格式,内容包括层和几何图形。CIF:(Caltechintermediate format),叫caltech中介格式,是另一种基本文本的掩模描述语言。LEF:(Library exchangeformat),叫库交换格式,它描述了库单元的物理属性,包括端口位置、层定义和通孔定义。它抽象了单元的底层几何细节,提供了足够的信息,以便允许布线器在不对内部单元约束来进行修订的基础上进行单元连接。它包含了工艺的技术信息,如布线的层数、最小原创 2021-01-20 16:38:58 · 277 阅读 · 0 评论 -
[转载] 用calibre做LVL的两种简单方法 (转载)
用calibre做LVL的两种简单方法 (转载)tianxiong_14 发表于: 2009-2-13 09:59 来源: 半导体技术天地主题:用calibre做LVL的两种简单方法 申明:转载用calibre做LVL的两种方法:假设我们有两个版图文件,分别为1.gds和2.gds,顶层分别为TOP1和TOP2方法1。compare_gds 1.gds TOP1 2.gds TOP2 /tmp/diff.db -XOR原创 2021-01-18 10:45:14 · 3559 阅读 · 0 评论 -
2020-12-23[转载]一些有用的文章
get_cellget_cell -hier原创 2020-12-23 17:20:06 · 78 阅读 · 1 评论 -
layout版图工具中的使用小技巧
工具:skipper1 如何查看某个DM的归属,原创 2020-12-08 11:02:16 · 2606 阅读 · 0 评论 -
[转载]什么是ESD,什么是latch up
今天在查阅文档时发现了一个问题,我们在设计后端时经常要考虑到2个问题,问题1 ESD问题,为了防止ESD问题,保护电路。我们应该怎么做,首先介绍一下什么是ESD问题2 latch up问题。我们为了防止latch up我们应该怎么做。首先介绍一下什么是latch up链接: https://zhuanlan.zhihu.com/p/125519142....原创 2020-11-27 16:47:16 · 4231 阅读 · 2 评论