if-else写法和case写法在底层逻辑上实现的差异

本文探讨了在FPGA设计中,使用if-else和case语句在底层逻辑实现上的不同。通过非等占空比信号产生和序列脉冲信号的例子,分析了if-else可能导致的多级二选一数据选择器,而case语句能简化电路,减少资源消耗。通过功能仿真验证了两者功能等效,强调了优化电路设计的重要性。
摘要由CSDN通过智能技术生成

一、非等占空比信号产生方法

若要实现led灯闪烁,且亮暗时间可以人为决定,则需要输出占空比可调的PWM波,可参考如下代码(定时器部分省略):

always@(posedge Clk or negedge Rst_n)
if(!Rst_n)
	led <= 0;
else if(cnt == 49)
	led <= 1;
else if(cnt == 89)
	led <= 0;

此时输出端波形如图所示:
在这里插入图片描述

二、序列型脉冲信号产生方法

同理,也可以采用多个if-else的方法来设计一个波形序列,例如:

al
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