Quartus ii 13.1 数字时钟

内容摘要:

        使用计数器和数据选择器等器件实现数字时钟电路。电路最终在开发板上显示的是时钟的秒和分(开发板所限,当然如果开发板支持8位显示的话也可以自己加到小时位的显示)。电路包四个部分:时钟信号分频电路,开发板内置的是25MHz的时钟信号,要把它分频到1Hz;数码管显示控制电路;数码管选通电路;时分秒进制控制电路。

实现

一、基本电路原理框图

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        说明:这里没有采用晶体振荡器来产生时钟信号,而是用了开发板内置的25MHz的信号通过分频电路使之达到1Hz。

二、时分秒进制控制电路

基本进制电路准备

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图1 六进制电路图

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图2 十进制电路图

连接60进制计数器

在10进制和6进制计数器都正确的基础上,连接成60进制计数器,检查功能是否正常。

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图3 六十进制电路图

设计24进制计数器

参照60进制计数器的方法设计一个24进制计数器,检查功能是否正常。

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图4 二十四进制电路图

三、设计时钟信号分频器

开发板提供的时钟信号为25MHz的高频信号,但是我们需要能使信号变换为1秒一次的1HZ信号,所以需要设计25M的分频电路。

设计时钟信号分频器

开发板提供的时钟信号为25MHz的高频信号,但是我们需要能使信号变换为1秒一次的1HZ信号,所以需要设计25M的分频电路。

原理:先使用74292分频芯片进行2∧20分频,再对分频后的信号用计数器进行24分频。

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图5  25M分频电路图

74292芯片引脚及分频:

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四、运用上述的各功能电路进行电路组合

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图6 实验电路图

 五、结果记录

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从上述图片可以看到实验电路能成功运行,并且得到正确的结果

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Quartus II 13.1是由Altera(现已被英特尔收购)开发的一款集成电路设计软件,用于设计和验证数字逻辑电路。它提供了一套强大的工具和资源,用于设计、仿真和验证复杂的数字逻辑电路。 Quartus II 13.1拥有丰富的资源,使设计工程师能够开发高性能、低功耗和高可靠性的电路。其主要特点包括: 1. 设计实现工具:Quartus II 13.1提供了先进的设计实现工具,支持基于原理图和HDL(硬件描述语言)的设计流程。它具有功能强大的综合器,支持VHDL和Verilog等常用的HDL语言。 2. 时序分析和时钟设计:Quartus II 13.1允许设计工程师进行全面的时序分析,并提供了高级的约束管理工具。此外,它还支持多个时钟域的设计,使工程师能够精确控制电路的时序特性。 3. 逻辑优化和布局布线:Quartus II 13.1提供了强大的逻辑优化和布局布线功能,以实现最佳的性能和功耗平衡。它能够智能地将逻辑元件进行合并和优化,并生成最优化的布线方案。 4. 仿真和调试:Quartus II 13.1集成了ModelSim仿真工具,可以对电路进行有效的仿真和调试。它提供了丰富的仿真特性,如信号波形显示、事件触发和调试器等,可帮助工程师快速定位和解决问题。 总结来说,Quartus II 13.1是一款功能强大的集成电路设计软件,提供了丰富的工具和资源,具备高性能、低功耗和高可靠性的设计能力。它广泛应用于各种数字逻辑电路的设计和验证,有助于设计工程师提高工作效率并实现优秀的电路设计。

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