本文详细介绍了MSP430的时钟模块，包括高速晶体振荡器、低速晶体振荡器、DCO、锁频环FLL及FLL+等组成部分。时钟模块产生ACLK、MCLK和SMCLK三个时钟信号，分别服务于不同系统需求。此外，还讨论了低速晶体振荡器LFXT1和高速晶体振荡器XT2的工作模式，以及DCO振荡器在晶体振荡器失效时自动切换为系统时钟的功能。文章还涉及了时钟模块寄存器的配置，如DCOCTL和BCSCTL1、BCSCTL2的各个字段，以及中断管理和时钟源的选择流程。
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1. 时钟模块包括高速晶体振荡器、低俗晶体振荡器、数字控制振荡器DCO、锁频环FLL以及锁频环增强版本FLL+等部件构成。
2. 时钟模块产生3个输出结果：ACLK（辅助时钟），MCLK（主系统时钟）和SMCLK（子系统时钟）。
3. MSP430采用锁频环FLL以及锁频环增强版本FLL+等部件将晶体频率倍频至系统频率。数字控制振荡器DCO和锁频环FLL计数相结合可实现快速启动。在晶体振荡器失效时DCO可自动用于系统时钟。
4. 3个时钟输入源：
a) LFXT1CLK:低频时钟源
b) XT2CLK:高频时钟源
c) DCOCLK:数字控制RC振荡器
5. 3种时钟信号
a) ACLK：由LFXT1CLK信号经1、2、4、8分频后得到。ACLK可由软件选做各外围模块的时钟信号，一般用于低俗外设。
b) MCLK：由软件选择来自LFXT1CLK、XT2CLK、DCOCLK，然后经过1、2、4、8分频得到。MCLK主要用于CPU和系统。
c) SMCLK：可由软件选择来自LFXT1CLK和DCOCLK，然后经过1、2、4、
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