学习数字电路基础与Verilog设计的实验过程记录

于 2021-03-15 14:07:36 发布
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实验一：
步骤1：打开Quartus || ，找到file、new，弹出对话框并选择Verilog HOL File,然后将代码编入对话框中，编写完成后点击File、save，并将其保存在任意一盘中，但是保存路径只能为英文，创建新的文件夹将其命名为MUX41，详细步骤根据提示进行在这里插入图片描述
2.完成以上操作后点击编译，对编写的程序进行编译，出现警告提示时程序可以正常运行，如果出现错误则可以点击Flow Messages进行查看并对代码进行更改即可
在这里插入图片描述
3.点击Eidt对编译的程序进行仿真结果测试，并对终止时间进行设计，对信号进行设置，将仿真时间进行设置即可
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4.最终仿真的测试结果图
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