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RSS订阅翻译 CORDIC--HLS实现
1. 背景CORDIC(Coordinate Rotation Digital Computer)坐标旋转数字计算机是一种计算三角函数，双曲函数和其他数学函数的有效技术。CORDIC仅使用加法，减法，位移和表查找来执行简单计算，这些计算在FPGA中以及更一般地在硬件中实现是有效的。设计人员必须在结果的准确性，性能和设计的资源利用率之间进行仔细权衡。 CORDIC背后的核心思想是在二维平面中有...
2018-08-27 15:42:38
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翻译 FIR滤波器--HLS实现
1. 基本卷积操作y[i]=∑j=0N−1h[j]×x[i−j]y[i]=∑j=0N−1h[j]×x[i−j] y[i] = \sum_{j=0}^{N-1} h[j] \times x[i-j]2. 11抽头滤波器HLS代码#define N 11#include "ap_int.h"typedef int coef_t;typedef int data_t;typedef...
2018-08-23 20:27:04
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原创 RTL综合<2>----for循环
对于现在的仿真器，for循环一般都是可以综合的。`timescale 1ns / 1psmodule test( input clk, rst_n, input [7:0] data, output reg [2:0] num);//=====================================int
2016-10-14 15:37:58
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原创 RTL综合<一>
这次介绍一些有关RTL综合的知识组合逻辑综合可综合的逻辑可由以下方式描述：结构化的基本门网表一系列连续赋值语句一个电平敏感的周期性行为门级网表综合module test( input a, b, c, d, e, output y1_out, y2_out);wire y1, y2, y3, y4, y5, y6, y7, y8;and (y1, a,
2016-10-13 21:17:31
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原创 Verilog中的批处理generate和缩减运算符
最近在写贪吃蛇程序时遇到了一个问题，贪吃蛇的每节参数必须全部定义，相当于一个结构体，里面有坐标和方向，当我想把贪吃蛇的长度从2节变为多节时，遇到了一个很大的问题，虽然后面每节的代码和前面的近似，但是代码量巨大，一个一个复制会非常麻烦，于是经过查资料后，发现generate语句是个不错的东西。在body结构体中，每次移动 body1_x <= head_x; body1_y <= hea
2016-10-13 19:49:31
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简单的verilog贪吃蛇小程序
2016-10-26
空空如也
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