数字验证学习笔记——UVM学习4 phase机制

已于 2022-12-04 16:10:15 修改
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分类专栏： 验证学习 UVM 文章标签： 学习
于 2022-12-04 09:33:26 首次发布
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本文链接：https://blog.csdn.net/qq_32100199/article/details/128169277
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一、phase机制

SV的验证环境构建中，我们可以发现，传统的硬件设计模型在仿真开始前，已经完成例化和连接了；而SV的软件部分对象例化则需要在仿真开始后执行。
虽然对象例化通过调用构建函数new（）来实现，但是单单通过new（）函数无法解决一个重要的问题，就是验证环境在实现层次化时，如何保证例化的先后关系，以及各个组件在例化后的连接。
此外如果要实现高级功能，例如在顶层到底层的配置时，SV也无法在底层例化之前完成对底层的配置逻辑。
因此UVM在验证环境构建时，引入phase机制，通过该机制很清晰地将UVM仿真阶段层次化。
这里的层次化，不单单时各个phase的先后执行顺序，而且同一phase中的层次化组件之间的phase也有先后关系。
在这里插入图片描述
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在所有的phase中，只有run_phase方法是一个可以耗时的任务，这意味着该方法可以完成一些等待、激励、采样的任务。对于其他phase对应得方法都是函数，必须立即返回。
在run_phase中，用户如果要完成测试，通常需要组织下面得激励序列：

  • 上电
  • 复位
  • 寄存器配置
  • 发送主要测试内容
  • 等待DUT完成测试
    在这里插入图片描述
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    UVM顶层结构
  • ROOT
    • TEST
      • ENV
        • 各个组件
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objection 是用来控制仿真退出
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objection实例一
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objection实例二
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