一只迷茫的小狗-CSDN博客

原创 Serial RapidIO Gen2Endpoint v4.1 (PG007):Chapter 2:Product Specification

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2026-03-31 15:51:37 440

原创关于systemverilog中在task中使用force语句的注意事项

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2025-05-19 16:52:22 678

原创 verilog/systemverilog中的位序问题

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2025-03-28 17:30:14 434

原创 C语言数据上溢

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2025-02-21 13:34:39 675

原创 C 语言使用指针前是否需要判断为NULL

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2025-02-21 11:02:49 481

原创 Verilog中generate的用法

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2024-12-06 14:47:03 1505

原创 IEEE Standard for SystemVerilog—Chapter27. Generate constructs

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2024-12-06 12:10:44 846

原创 TCL脚本在QuestaSim和ModelSim中的应用

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原创谈谈PCIE的地址映射

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原创在Modelsim中独立调用Vivado的PCIE IP核仿真测试的方法

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2024-12-02 09:30:59 1411

原创 PCIe bar、Type0、Type1

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原创 verilog中位宽表示法

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原创 $value$plusargs用法

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原创 modelsim命令：add button

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原创 modelsim命令：add atv

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原创 modelsim命令：abort

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原创 modelsim命令.main clear

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原创 Verilog赋值冲突

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原创 ModelSim® SE User‘s Manual Chapter 20 Finite State Machines

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原创使用modelsim的dataflow窗口调试

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原创 SystemVerilog中的Semaphores

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原创 IEEE Systemverilog :Chapter 15. Interprocess synchronization and communication

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原创 SystemVerilog disable语句的注意点

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原创 ModelSim® SE Command Reference Manual ： find命令的用法

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原创 ModelSim® SE Command Reference Manual：find connections命令的使用

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原创 SystemVerilog中数组内置函数sum()的一个注意点

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原创 Systemverilog inside匹配规则

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原创 SystemVerilog中 $cast动态强制类型转换

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原创 windows下使用modelsim搭建uvm验证环境时遇到问题:can‘t locate a C/C++ compiler for ‘DPI Export Compilation ‘。

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原创 SystemVerilog验证测试平台：2.2章节：定宽数组

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原创 Vivado 统计代码覆盖率

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空空如也

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