vivado中Cordic IP核使用：计算正余弦（sin/cos）

东枫科技

已于 2023-11-07 14:31:37 修改

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分类专栏： FPGA - 面向物理层基带算法工程师文章标签： USRP FPGA 通信 fpga开发

于 2023-11-07 14:30:13 首次发布

本文链接：https://blog.csdn.net/qq_36666115/article/details/134266628

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本文介绍了如何在IP核中配置端口，如wire[15:0]pm_i和pm_q，以及使用Cordic算法进行基带PM调制，包括Matlab中的基带I路和Q路实现。着重展示了数字信号处理中的A/D转换技术应用。

摘要生成于 C知道，由 DeepSeek-R1 满血版支持，前往体验 >

输入输出原理

在这里插入图片描述

IP核配置

在这里插入图片描述

端口

在这里插入图片描述

调用

wire [15:0] pm_i,pm_q; // fix16_14  Q1.14
com_cordic_pmmod_io16 PM_Baseband_Modulation (
  .aclk(clk),                                // input wire aclk
  .aresetn(~rst),                          // input wire aresetn
  .s_axis_phase_tvalid(1'b1),  // input wire s_axis_phase_tvalid
  .s_axis_phase_tdata(pm_phase),    // input wire [15 : 0] s_axis_phase_tdata Q2.13
  .m_axis_dout_tvalid(),    // output wire m_axis_dout_tvalid
  .m_axis_dout_tdata({pm_q,pm_i})      // output wire [31 : 0] m_axis_dout_tdata
);

对应的matlab 完成PM调制

carr_receive_I(n1) = cos( mdt*data(floor(data_nco_phase/2^32)+1)*cos(wdt_nco_phase/2^32*2*pi)); % 基带I路
carr_receive_Q(n1) = sin( mdt*data(floor(data_nco_phase/2^32)+1)*cos(wdt_nco_phase/2^32*2*pi)); % 基带Q路