HDLBits Fsm ps2

闪光的正幸

于 2023-02-18 17:55:46 发布

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分类专栏： FPGA HDLBits刷题文章标签： fpga开发

本文链接：https://blog.csdn.net/qq_43406377/article/details/129102822

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文章介绍了如何运用状态机的思想来解决数字逻辑设计中的问题，特别提到了设置状态机的位宽以处理多个状态，并给出了一个Verilog代码示例，展示了状态机在A、B、C、D四个状态间的转换逻辑，以及如何根据输入条件决定状态转移。

摘要由CSDN通过智能技术生成

1、这个题刚看到时确实没啥思路，主要是对状态机这个思想的运用还不熟练，不知道怎么发现多个状态

2、设置状态机时，如果有多个状态记得设置状态机的位宽。

3、要学会用状态机的思想来解决问题。

这个题的状态机示意图

完整代码如下：

module top_module(
    input clk,
    input [7:0] in,
    input reset,    // Synchronous reset
    output done); //
	parameter A=0,B=1,C=2,D=3;
    reg [2:0]state,next_state;
    always@(*)begin
        case(state)
            A:next_state=in[3]?B:A;
            B:next_state=C;
            C:next_state=D;
            D:next_state=in[3]?B:A;
            default:next_state=A;
        endcase
    end
            
    // State transition logic (combinational)
    always@(posedge clk)begin
        if(reset)begin
            state<=A;
        end
        else begin
            state<=next_state;
        end
        
    end
    // State flip-flops (sequential)
    assign done=(state==D);
    // Output logic

endmodule