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数字IC前端EDA工具使用教程
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数字IC前端EDA工具使用教程
不吃葱的酸菜鱼
数字IC前端/机器学习算法
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综合工具-Design Compiler使用(从RTL到综合出各种报告timing\area\critical_path)
mkdir是创建文件夹,ls是查看当前文件夹内容,你看,我说了那么多命令,你大概率每一个都很熟悉,因为在使用linux操作系统的时候,这些命令太常见了,而DC里面无论是设置路径也好,设置目标工艺库也好,下时序约束也好,用到的命令也就那些东西,一开始迷迷糊糊没事,你就记住,多练多coding,自然就熟悉了。另外的,如果我们要把我们在dc_shell中输入的那些约束信息,全部打印出来,生成一个.sdc结尾的时序约束文件,可以在dc_shell中输入:write_sdc full_adder.sdc。原创 2022-10-27 12:57:25 · 3483 阅读 · 3 评论 -
VIM文本编辑器基本操作
在 linux 的 teminal 界面,输入gvim asyn_FIFO.v &,可以进入asyn_FIFO.v 文件,刚进去默认是命令模式,在打开文件的时候 结尾输入 & 表示。下,Vim 可以对文件执行写操作。控制 Vim 光标移动的时候,可以用方向键,但是建议还是用hjkl,因为方向键离得比较远,每次移动的时候手要移动很长一个距离,所以用hjkl好。在命令模式下,用hjkl移动光标,如果要进行插入,可以按一下 i 键,然后就可以在光标所在位置的左侧进行输入,如果要退出输入模式,就按 Esc。原创 2022-10-27 12:47:23 · 2734 阅读 · 0 评论 -
逻辑仿真工具VCS的使用-Makefile
上一次讲了Gvim的基本操作,今天来讲讲用Gvim写出一个RTL codes后怎么用VCS仿真,还会结合Makefile做文件的自动化处理。之后还会出DC的使用教程,如果能完成这么一套流程的话,写在简历上会很唬人:Gvim写RTL code,VCS仿真,Verdi看波形,DC做综合下约束,Primetime做STA,Spyglass做异步时序分析。原创 2022-10-27 12:41:47 · 4221 阅读 · 3 评论 -
VCS & Veidi 下载与安装教程 一站式虚拟机套餐
所有软件,基本你能想到的软件(VCS、Verdi、DC、PT、vim),都已经安装好了,一步到位安装,直接把饭喂到你嘴里,送到你胃里。下载的是虚拟机的镜像文件,镜像文件里面已经把文件都安装破解好了,只需要导入镜像文件就可以了,总共分两步:① 下载VMware,网盘分享里也有了。② 打开VMware,新建虚拟机,把下载并解压后的EDAOS加入虚拟机就行了,安装。原创 2022-09-28 16:42:14 · 2864 阅读 · 20 评论