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原创 C++实现增序含头结点的单链例题：现已知单链表L中结点是按整数值递增排列，试写一算法将值为X的结点插入到表L中，使得L任然递增有序
【代码】C++实现增序含头结点的单链例题：现已知单链表L中结点是按整数值递增排列，试写一算法将值为X的结点插入到表L中，使得L任然递增有序。
2023-12-22 15:46:44
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原创 含头结点单链表实现：初始化，取值、查找、插入、删除五大功能的解决方案附代码详解
/链表打印函数printf("列表信息为：");p!= NULL;p=p->next)//链表循环//链表元素个数计算!!空表");return 0;p!= NULL;p = p->next)//链表循环计算链表元素个数//count0从最后一个结点到NULL多计一次，比元素值多1//使用尾插法创建一个链表//创建头结点//将分配到的“struct STU”大小的内存转换为struct STU*类型//struct STU类型的指针P指向头指针head。
2023-11-21 10:10:41
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原创 1：C语言顺序表实现：模拟简单图书管理系统，顺序表初始化、取值、查找、插入、删除；附超详细代码解析 2:VS中warning C4473: “scanf_s”: 没有为格式字符串传递足够的参数（解决方
define MAXSIZE 20//限制结构体BOOK最大容量#define QUANTITY 21//限制顺序表最大元素个数.h文件对后续函数变量的定义、顺序表的定义typedef struct//图书基本信息定义int number;//书号//书名//书价}BOOK;//数据域的结构体类型BOOK* elem;//存储空间的基地址，顺序表指针动态赋存储空间//L.elem存储所需空间的地址，后将为基地址申请空间存放数据int length;//图书表中当前图书个数}SqList。
2023-10-15 00:20:10
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原创 FPGA实现：特定序列生成，特定子序列检测以及子序列出现次数数码管显示的方法及应用
/将次态赋给现态beginif(clr)beginstate
2023-10-06 19:37:53
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原创 使用数组创建链表的解决方案
因为在创建链表时用到了这种方法，后面发现这种方法创建链表做删除操作时不是很好，就打算删除，但是觉得这种方法可能对部分读者有参考意义，就基于数组创建链表的方法单独发了一篇，完整的~链表五大基础操作的实现方法可参考：http://t.csdnimg.cn/4i6SFhttp://t.csdnimg.cn/4i6SF .h文件中对工程所有需要的头文件都进行了引用，所以可以不再需要重复定义（关于#pragma once的使用方法）关于 .c文件中对.h文件的引用案例，在博主的数据结构专栏，顺序表的那
2023-12-28 17:19:29
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原创 基于Quartus Prime平台从新建工程开始以verilog HDL File保存为顶层文件并采用例化模块的设计方法，RTL Viewer、Sgnal Tap Logic Analyzer的使用
会建工程的读者可以跳过子目录新建工程。
2023-12-25 00:06:51
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原创 基于Quartus Prime平台FPGA关于VGA显示的模块化设计：VGA八种单色屏1s切换显示、横条纹、竖条纹、棋盘格显示、显示模式按键可调、数码管显示单色屏序号
VGA 15针端口，也称为VGA D-sub 15针接口，是常见的VGA连接器，用于连接计算机和显示器之间的视频信号传输。下面是VGA 15针端口的功能介绍：1. 红色信号（Red）：通过这个引脚传输红色信号，用于显示图像中的红色分量。2. 绿色信号（Green）：通过这个引脚传输绿色信号，用于显示图像中的绿色分量。3. 蓝色信号（Blue）：通过这个引脚传输蓝色信号，用于显示图像中的蓝色分量。4. 水平同步信号（HSync）：通过这个引脚传输水平同步信号，用于同步显示器上图像的扫描行。
2023-12-14 21:59:18
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原创 动态规划——数塔问题（三维数组的应用）
声明：理论指导《算法设计与分析 第四版》因为这个地方用到了三维数组，感觉很有意思就故意挑出来分享给大家（三维数组可以看成很多页二维数组）4.5.1认识动态规划如图4-12所示的一个数塔，从顶层到底层或从底层到顶层，在每一结点可以选择向左走或是向右走，要求找出一条路径，使路径上的数值和最大。(1）不难理解，这个问题用贪婪算法有可能会找不到真正的最大和。以图4-12为例就是如此。采用贪婪策略，无论是自上面下，还是自下而上，每次向下都选择较大的一个数移动，则路径和分别为：数塔图。
2023-12-11 23:21:25
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原创 二叉树递归实现：统计二叉树结点数、统计叶子节点数、换左右子树、复制二叉树；二叉排序树建立并实现查找；顺序表：学生成绩录入并按成绩排序
/节点数据域//左右孩子指针//七顺序表实现学生成绩存储以及排序//--------------------------------------------------------}STU;//学生信息存储//存储空间的基地址，顺序表指针动态赋存储空间int length;}SqList;#define MAXSIZE 30//限制结构体STU最大容量#define QUANTITY 21//限制顺序表最大元素个数。
2023-12-08 18:52:03
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原创 VScode搭建C和C++编译、调试环境配置的详细解决方案
3>解决找不到.h文件的问题仔细观察2>处的图，在建立.h文件使我们没有把它和.c文件建立在同一个目录（demo_1）下，而是放在了Project_c下，如果没有放错地方是不会出现2>的错误的解决方法：鼠标选中Add.h文件拖拽到demo_1目录下。
2023-11-16 08:07:21
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原创 EDA从原理图画到PCB板详细教程
也可以，快捷键E，再选择GND将所铺的铜接地。并用相同的方法给底层大面积敷铜。布线->自动布线->运行。右侧属性栏可调节文本信息。
2023-11-15 10:37:04
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原创 链栈实现：初始化、入栈、出栈、取栈顶元素、打印链栈
代码内含注释，就不过多赘述了，有疑问的读者，可以在评论区讨论，也可以私信一起交流学习文件是.cpp文件，其兼容性相对来说比较强，代码也用到了部分c+＋的语法例如：函数传引用和利用new函数申请空间等如果想单纯使用c语言编写的读者可以查阅相应的解决方法。
2023-11-13 10:36:45
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原创 栈的应用案例：括号匹配的检验{ [ ( ) ] }
当计算机接收到第1个括号后，他期待着与其匹配的第8个括号的出现，然而等来的却是第二个括号，显然第2个 括号的期待急迫性高于第1个括号，此时第1个括号“ [ ”只能暂时靠边，而迫切等待与第2个括号相匹配的第7个括号“ ）”的出现。类似地，因等来的是第3个括号“ [ ”，其期待匹配的程度比较低2个括号更急迫，则第二个括号也只能靠边，让位于第3个括号。在接收了第4个括号之后，第3个括号的期待得到满足，消解之后，第2个括号的期待匹配就成为当前最急迫的任务了，以此类推。可见，处理这个过程恰与栈的特点相吻合。
2023-11-11 12:42:03
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原创 Altium Designer PCB画板并对其进行信号完整性分析；包含Altium Designer的基础操作以及信号完整性分析的详细过程
Altium Designer PCB画板并对其进行信号完整性分析；包含Altium Designer的基础操作以及信号完整性分析的详细过程
2023-11-07 15:38:19
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原创 1、顺序表实现：存储学生三科成绩以及总分，实现成绩查询、按总分排序、求科目平均分2、本文含goto的使用、顺序表的建立与初始化等知识点的相关应用
因为比较简单就不过多赘述，有问题的读者可以在评论区评论，看到后会解答。
2023-11-06 15:39:08
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原创 顺序栈实现：空栈构造、销毁栈、清空栈、检测栈是否为空、返回栈元素个数、访问栈顶元素、插入栈顶元素、删除栈顶元素并返回其值、从栈底到栈顶依此访问栈元素九大功能的解决方案
while (1)printf("输入功能序号：\n");printf("输入非法，请重新选择！！\n");break;//遍历栈元素break;case 8:printf("删除的栈顶元素为：%d\n", Ele);break;
2023-11-03 22:06:06
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原创 关于含头结点链表实现（创建、交集、并集、差集）的解决方案
int data;//结构体的数据域//结构体的指针域//创建头结点printf("请输入你想创建的链表元素个数：\n");i < amount;i++)//创建新结点//printf("请输入第%d个元素的数据,且输入为递增序列：\n", i + 1);//将输入数据存入结点的数据域中//将链表最后一个结点指向空，否则为一个不确定的值//链表合并= NULL)}//List1最后一个元素的指针域指向空，另其指向List2的第二个结点就好。
2023-11-01 17:43:05
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原创 Verilog关于摩尔型状态机的编写案例(以出现特定序列：出现3个及3个以上的1标志量输出1为例)
parameter定义常量，可以定义在模块内部或外部；常用于定义位宽或时间延迟（易变），定义方式为： parameter 标识符 = （位宽）常数；// 位宽默认为32位，如果指定位宽则以指定值为准。
2023-10-29 23:55:42
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原创 Verilog实现简易电子琴，（4*4+5）矩阵键盘控制的21个单音输出
其原理为：主板生成四位周期序列（1110,1101,1011,0111），并将四位数据通过IO口送入矩阵键盘，当A端为1110时，如果按键KEY0按下（key_column_0,1,2,3）输出分别为0111，如果KEY1按下（key_column_0,1,2,3）输出分别为1011；如果此时KEY4按下（key_column_0,1,2,3）输出分别为1111；按键不按下是2脚悬空，为1；以此为确定哪个按键按下。input rst;//5个高音拨档开关//按键输出信号。
2023-10-27 11:44:38
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原创 Quartus prim实现模块化电路设计，生成子电路元件并在Block Diagram File中调用的解决方案（关于FPGA的复杂工程设计的相关博客都会采用此方法）
<1>新建工程<2>新建Block Diagram File<3>保存为顶层文件<4>新建Verilog HDL File 文件(用来编写子模块电路代码)<5>保存文件并命名文件<6>调用元件<7>设置端口属性
2023-10-19 12:49:22
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原创 立创EDA画图基础笔记
方法二：点击元件库，在元件库中搜索所需要的元件编号，将会出现很多不同型号以及封装的相同元件，可以根据自己需求选择。第一行第六列中的文本工具：快捷键：T 标注了蓝色字体的电路名称。
2023-10-17 17:01:14
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原创 基础算法编程题：（1）一个顾客买了价值x元的商品（不考虑角、分），并将y元的钱交给售货员：编写代码：在各种币值的钱都很充分的情况下，使售货员能用张数最少的钱币找给顾客（2）将输入数字编号翻译为英文编号
【代码】基础算法编程题：（1）一个顾客买了价值x元的商品（不考虑角、分），并将y元的钱交给售货员：编写代码：在各种币值的钱都很充分的情况下，使售货员能用张数最少的钱币找给顾客（2）将输入数字编号翻译为英文编号。
2023-10-16 17:17:45
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