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原创 FPGA之道(84)功能仿真之Verilog Test Fixture
文章目录前言Verilog Test Fixture“Hello world”之Verilog Test Fixture待仿真设计仿真示例示例详解仿真结果继承描述语法时间相关语法系统时间单位及精度设定延时等待语法有限等待语句无限等待语句变换等待语句边沿等待语句条件等待语句赋值等待语句阻塞赋值等待语句非阻塞赋值等待语句时钟激励语法占空比50%时钟产生方法高、低电平参数时钟产生法占空比、周期参数时钟产...
2020-04-15 20:50:59 2918
原创 FPGA之道(83)功能仿真之仿真语法(Graphic Waveform )
文章目录前言仿真语法Graphic Waveform数字波形简介从实际到仿真实际系统检测软件仿真模拟“Hello world”之Graphic Waveform待仿真设计一些绘制波形的操作添加端口创建时钟信号钳制与释放信号电平翻转生成随机序列总线设置一些观察波形的操作波形缩放总线观察添加时标边沿寻找波形仿真结果分析及重要注意事项一、如果判断仿真结果对与错?二、仿真0时刻的意义。三、“边沿对边沿”的...
2020-04-14 22:01:30 2320
原创 FPGA之道(82)功能仿真之仿真原理
文章目录前言功能仿真篇仿真原理串行模仿并行思路分析有限模仿无限思路分析组合逻辑仿真原理时序逻辑仿真原理HDL的仿真原理仿真时间与物理时间前言本文摘自《FPGA之道》。功能仿真篇功能仿真是所有仿真类型中最重要的,也是占项目开发比重最大的仿真,对任何一个项目的开发来说几乎都是必须的,所以在此单独使用一个篇章对它进行介绍。因此,本篇所指的“仿真”若无特别说明,皆泛指功能仿真。仿真原理功能仿真...
2020-04-14 12:58:11 2651
原创 FPGA之道(81)静态时序分析(七)根据时序报告修改设计(基于ISE的UCF文件语法)
文章目录前言根据时序报告修改设计时序分析报告示例待分析设计时序约束文件时序报告简介报告综述内部时钟报告输入接口报告输出接口报告输出数据延迟报告输出时钟延迟报告同步输出综合报告常见问题及修改可以不改的一些问题常见时序收敛的手段逻辑化简&结构调整分布调整缓存降频复用&逻辑拆分&流水线&使能链模块输入、输出寄存处理时钟上树DCM、PLL相位调整使用延迟模块使用综合约束改变...
2020-04-13 19:32:22 4815
原创 FPGA之道(80)静态时序分析(六)常用时序约束介绍(基于ISE的UCF文件语法)
注意,时序分析环节仅仅是用来对FPGA设计的实现进行评估并给出相应的结果报告,它并不会对FPGA设计进行改变。但如果我们在使用诸如ISE、Quarters这样的集成开发环境时,如果在映射环节还没开始前就添加一些时序约束信息,则这些编译器每完成一部分布局布线工作,便会调用相应时序分析工具进行一次时序分析,如果发现分析结果不符合要求,则会返回重来。像这样,编译器经过多次反复努力,力求达到时序约束中的要求,从而给我们一种“时序分析改变FPGA实现”的错觉。
2020-04-06 14:47:44 5000
原创 FPGA之道(79)静态时序分析(五)外部接口的相关时序分析
文章目录前言外部接口相关时序分析功能仿真对接口分析的帮助纯输入接口纯时钟输入接口纯同步输入接口纯异步输入接口同步输入异步采集纯输出接口纯时钟输出接口纯同步输出接口纯异步输出接口异步生成同步输出可完全拆解复合接口不可完全拆解复合接口纯组合逻辑接口输入、输出直接共用时钟接口输入为主的直接共用时钟接口输出为主的直接共用时钟接口输入、输出间接共用时钟接口前言本文摘自于:《FPGA之道》。外部接口相关...
2020-04-04 22:22:21 2229
原创 FPGA之道(78)静态时序分析(四)内部时钟相关时序分析
文章目录前言内部时钟相关时序分析单时钟域时序分析多时钟域时序分析同源时钟的时序分析PLL、DCM的时序分析相关时钟的时序分析数据用作时钟的时序分析异步逻辑时序分析多时钟驱动同一时钟域的时序分析Latch相关的时序分析前言本文摘自于:《FPGA之道》。内部时钟相关时序分析时序分析的情形可以概括分为两大类:一类是和内部时钟相关的时序分析,它用来保证FPGA内部逻辑可以对数据进行正确处理;另一类...
2020-04-04 21:49:38 2507
反馈清零以及反馈置数计数器(内含Verilog HDL代码及文档)
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模60计数器(通过计数器级联得到)
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数字时钟计数器(包含代码及说明文档)
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乘法器的verilog HDL设计汇总
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移位相加乘法器的verilog HDL设计代码
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串行乘法器verilog HDL设计代码
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查表法乘法器verilog HDL设计代码及其测试文件
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复数乘法器的verilog HDL设计代码及其测试文件(修改版)
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向量乘法器的verilog HDL设计代码及其测试文件(修改版)
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复数乘法器的verilog HDL设计代码
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Wallace树乘法器专题研究
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可逆计数器(内含文档及Verilog HDL设计代码)
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