Cortex-M0反汇编中关于PC的理解

最新推荐文章于 2024-01-23 17:26:23 发布
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分类专栏： Cortex-M0 文章标签： Cortex-M0 PC
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本文链接：https://blog.csdn.net/u012874587/article/details/78803759
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本文介绍了Cortex-M0的基础知识，包括指令集和流水线架构。重点讨论了PC值，特别是LDR命令如何使用PC值加载地址，并通过例子解释了0x000000D4位置的"LDR r0，[pc，#40]；@0x00000100"指令的含义，以及PC值与当前执行指令地址的关系。
摘要由CSDN通过智能技术生成

一、关于Cortex-M0的基础知识

1、指令集

CortexM0是CortexM家族中的微处理器核心，其拥有最低闸数、最低功耗以及强悍性能的优异表现。CortexM0为32位、3级流水线的RISC处理 器，其核心与 ARM7同为
冯·诺依曼(Von Neumann)架构，采指令和数据共享同一总线的设计。
CortexM0同时支持了Thumb和部分的Thumb2指令集，核心不论是在正常程序执行还是处理中断异常模式均保持在单一Thumb状态下执行，免去了不 必要的状态切换，
大幅地节省了执行时间和指令码大小。Thumb指令集为一16位长度之指令码，为ARM指令集之子集，程序代码密度提高了一倍，但可能需要更多的指令去执行相
同的任务，所以造成了性能的下降。

2、流水线架构

CortexM0为32位、3级流水线RISC处理器，其核心与ARM7同为冯·诺依曼(Von Neumann)架构，采指令和数据共享同一总线的设计。
 
从图中可以看出，一条汇编指令的运行有三个步骤&#x
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