基于Montgomery算法的高速、可配置 RSA密码IP核硬件设计系列(四)——数字模块的总体实现方案

已于 2022-06-20 11:34:51 修改
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分类专栏： 数字硬件安全--精选 文章标签： 密码学 RSA 蒙哥马利模乘
于 2021-02-27 20:42:53 首次发布
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本文介绍了基于Montgomery算法的高速、可配置RSA密码IP核硬件设计，详细阐述了数字模块的总体设计方案，包括总体实现架构、总线接口功能，特别是AXI总线Master模块接口及其在RAM读写操作中的应用。设计中，RSA芯片采用32位CPU架构，通过AMBA 4.0 (AXI 4)总线协议进行数据传输，支持不同位宽的RSA计算模式。
摘要由CSDN通过智能技术生成

基于Montgomery算法的高速、可配置RSA密码IP核硬件设计系列（四）


原创声明：本系列所有的博文都是本人参考相关的文献资料后，独立撰写，组织语言后，编写本系列博文， 未经作者允许，严禁转载；

基于Montgomery算法的高速、可配置 RSA密码IP核硬件设计系列(四)
本次第四部分主要介绍相关项目的具体模块的设计方案，如数字模块的总体设计方案；

2 数字模块实现方案

2.1 总体模块设计

整个RSA 加密系统是一个软硬件协同工作的系统。 PC机端通过运行控制软件, 该软件通过PC 机的串口与RSA加密芯片通信。 加密芯片内部包含有嵌入式的CPU, ROM, RAM, UART 和高速RSA 协处理器模块, 所有模块都挂在AMBA 总线上[12-16]。加密时, PC 机将待加密的明文、密钥等信息传输给芯片；加密完成后, 芯片将加密后的密文发给PC。

2.1.1 总体实现架构

在算法设计要求的基础上，对高速、可配置RSA密码IP核芯片架构进行了设计，适用于32位CPU架构，如下图2.1.1所示。
在这里插入图片描述
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