HLS：for循环优化

最新推荐文章于 2024-05-24 21:10:54 发布
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分类专栏： FPGA vivado HLS
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本文介绍了HLS中的for循环优化，包括基本性能指标如循环执行次数和延迟，以及pipeline和unrolling等技术。讨论了循环合并、数据流优化，特别是针对嵌套for循环的三种类型。文章还探讨了其他优化方法，如循环并行化、函数封装并行运行以及处理可变循环边界的策略。
摘要由CSDN通过智能技术生成

文章目录

1. 基本性能指标

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2.performance matrics

loop trip count :循环执行了几次
loop interation latency :循环一次用了几个cycle
loop interation latency(Loop II) :两次循环直接间隔了几个cycle
loop latency:整个for循环的latency
function latency
function initial interval（II）
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pipeline

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流水线为什么是这样，为什么不能完全并行呢？
因为memory端口只有一个？

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unrolling

默认用同一套电路，分时复用
unroll就是 对电路进行复制，复制几份是可以选择的在这里插入图片描述
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3.循环合并

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"这篇资料主要介绍了使用Vivado HLS进行FPGA设计时的for循环优化技术，包括pipeline和UNROLL展开。文中详细讲解了for循环pipeline如何通过改善latency和interval提升性能，并对比了pipeline前后执行结构的差异。此外...
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