上拉电阻之-------强上拉与弱上拉

最新推荐文章于 2024-09-09 10:45:39 发布
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弱上拉和弱下拉的理解  2010-11-23 17:59  


弱上拉就是当输出高电平时，能够输出的电流很小

很容易被别的强下拉拉低，因而叫做弱上拉。例如上拉电流为几百uA这样子。


上拉电阻的大小来决定上拉能力！

小电阻强上拉！

大电阻弱上拉！


你想，用1M的电阻来上拉5V，与用100欧的电阻来上拉5V，谁能力强？

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单片机上拉电阻、下拉电阻的详解和选取
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上拉就是将不确定的信号通过一个电阻嵌位在高电平！电阻同时起限流作用！下拉同理！ 上拉是对器件注入电流，下拉是输出电流。
什么是强上拉、弱上拉、强下拉、弱下拉？
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07-21 7039
前言 一般来说， http://bbs.eeworld.com.cn/thread-1070283-1-1.html http://bbs.eeworld.com.cn/thread-239124-1-1.html https://www.zhihu.com/question/23167435
弱上拉和强上拉的区别（转载）
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qq_47931801的博客
09-09 172
答：按键的上拉电阻可以是3.3k、4.7k、5.1k、10k都可以，但是电阻越小功耗越大，在现在的智能生态下，我们做追求的是低功耗，高效率，10k是大多数智能产品芯片所能识别到的引脚电流，如果电阻太大，电流太小，引脚识别不了，所以10k是个折中的方案。例如，以接上拉电阻举例，在STM32刚上电的时候，芯片引脚电平是不定的，特别引脚是接按键的时候，必须给他个确定的电平，下拉电阻的作用就是如果前面的引脚电平不定的话，强制让电平保持在高电平。答：上拉电阻：电阻一端接VCC，一端接逻辑电平接入引脚(如单片机引脚)
到底什么是弱上下拉和强上下拉？
jk_101的博客
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太大的话，会影响IIC的通信速度，因为总线上还有负载电容，电阻太大，电容充放电时间就会久，影响上升沿、下降沿时间。补充说明，上面介绍的上下拉电阻是对MCU IO输入来说的，输出也可能会用到，比如对于开漏输出的IO，就必须加上上拉电阻，否则输出不了高电平。它只有一个NMOS，当控制输出0时，NMOS导通，Output Pin输出0，但是当控制输出1时，NMOS截止，输出的是高阻态。另外阻值也不能太大，阻值太大，上拉/下拉的作用就变弱，越大越接近于开路，开关断开时IO就越接近于浮空状态，就越容易受干扰。
推挽、开漏、强上拉、弱上拉、强下拉、弱下拉输出
monkea123的博客
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上拉（Pull Up ）或下拉（Pull Down）电阻（两者统称为“拉电阻”）最基本的作用是：将状态不确定的信号线通过一个电阻将其箝位至高电平（上拉）或低电平（下拉），无论它的具体用法如何，这个基本的作用都是相同的，只是在不同应用场合中会对电阻的阻值要求有所不同，从而也引出了诸多新的概念，本节我们就来小谈一下这些内容。 如果拉电阻用于输入信号引脚，通常的作用是将信号线强制箝位至某个电平，以防止信号线因悬空而出现不确定的状态，继而导致系统出现不期望的状态，如下图所示： 在实际应用中，10K欧姆的电阻是使用数
上、下拉电阻（定义、强弱上拉、常见作用、吸电流、拉电流、灌电流）
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1.上、下拉电阻定义 上拉电阻是把一个信号通过一个电阻接到电源(Vcc)，下拉电阻是一个信号通过一个电阻接到地(GND)。 2.强上拉、弱上拉 强上拉、弱上拉的强弱只是上拉电阻的阻值不同，没有什么严格区分。例如：50Ω上拉，一般成为强上拉；100kΩ上拉则称为弱上拉。下拉也是一样的。强拉电阻的极端就是0Ω电阻，即将信号线直接与电源或低相连接。 3.上、下拉电阻的作用 因为上下拉电阻的作用概念很宽泛，不用领域的使用方法也不同，常见使用方法整理如下： ...
上拉下拉再理解
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原文地址点击这里： 上拉（Pull Up ）或下拉（Pull Down）电阻（两者统称为“拉电阻”）最基本的作用是：将状态不确定的信号线通过一个电阻将其箝位至高电平（上拉）或低电平（下拉），无论它的具体用法如何，这个基本的作用都是相同的，只是在不同应用场合中会对电阻的阻值要求有所不同，从而也引出了诸多新的概念，本节我们就来小谈一下这些内容。如果拉电阻用于输入信号引脚，通常的作用是将信号线...
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主要需要考虑以下： 1.若考虑波形爬升下降速率，强上拉/下拉比较好，强上拉/下拉是用阻值低的电阻，时间常数小，波形变化快 2.若考虑EMI等干扰，强上拉/下拉比较好，由于使用的电阻阻值低，因此干扰电流引起的电压波动小 3.若考虑功耗和热量，弱上拉/下拉比较好，电阻大功耗低，产生的热量少，散热压力小从而可以把尺寸做的更小 参考： ...
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<br /><br />一.准双向口配置<br />如下图，当IO输出为高电平时，其驱动能力很弱，外部负载很容易将其拉至低电平。当IO输出为低电平时，其驱动能力很强，可吸收相当大的电流。<br />准双向口有三个上拉晶体管，一个“极弱上拉”，当端锁存器为逻辑“1”时打开，当端口悬空时，“极弱上拉”将端口上拉至高电平。<br />第二个上拉晶体管为“弱上拉”，当端口锁存器为逻辑“1”且端口本身也为“1”时打开，此上拉提供的电流，使准双向口输出为“1”。如果此时端口被外部装置拉到逻辑“0”时，通过施密特触发器，
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