阻抗匹配--PCB布线 & Cable

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阻抗匹配导致的问题

## 问题描述
	信号为5M左右的方波信号(En_A, En_B)差分线到电机控制器，信号频率大概5M。这个方波信号同时另外并联一路到 1Cable, 该Cable阻抗匹配线大概是5m。在Cable的尽头没有做阻抗匹配。
	假如不连接5m Cable，电机高速（En_A相应的频率也高）/低速都可以运行。但是一连接5m Cable,电机只能低速运行。
## 问题解决
		比对信号，5m Cable在终端有120ohm匹配电阻和没有匹配电阻的情况下
			-No 120ohm RES: 信号幅度高， 和倾斜
			-120ohm RES --信号正常而且正。

## 结论：
	1.反射造成的影响与频率，线长度成正比关系
	2. 编码器，假如倾斜的话会导致一个周期内的4细分不能区分。

1. DC/低频回路

1.1，对于纯电阻型回路（理想的纯电阻回路，对于高频也没有关系）

信号源内阻==负载阻抗，实现负载最大输出功率

1.2，含有感性/容性回路

需要信号源与负载阻抗的的实部相等，虚部互为相反数，这叫做共厄匹配，得到最大功率输出

2. 高频回路

考虑反射问题，传输线的特征阻抗==负载阻抗
在高频电路中，我们还必须考虑反射的问题。当信号的频率很高时，则信号的波长就很短，当波长短得跟传输线长度可以比拟时，反射信号叠加在原信号上将会改变原信号的形状

3. 高频回路阻抗匹配的方法

3.1，可以考虑使用变压器来做阻抗转换，就像上面所说的电视机中的那个例子那样
3.2， 可以考虑使用串联/并联电容或电感的办法，这在调试射频电路时常使用
3.3，可以考虑使用串联/并联电阻的办法。一些驱动器的阻抗比较低，可以串联一个合适的电阻来跟传输线匹配，例如高速信号线，有时会串联一个几十欧的电阻。而一些接收器的输入阻抗则比较高，可以使用并联电阻的方法，来跟传输线匹配，例如，485总线接收器，常在数据线终端并联120欧的匹配电阻
a. 串联终端匹配
在信号源端阻抗低于传输线特征阻抗的条件下，在信号的源端和传输线之间串接一个电阻R，使源端的输出阻抗与传输线的特征阻抗相匹配，抑制从负载端反射回来的信号发生再次反射。
匹配电阻选择原则：匹配电阻值与驱动器的输出阻抗之和等于传输线的特征阻抗。常见的CMOS和TTL驱动器，其输出阻抗会随信号的电平大小变化而变化。因此，对TTL或CMOS电路来说，不可能有十分正确的匹配电阻，只能折中考虑。链状拓扑结构的信号网路不适合使用串联终端匹配，所有的负载必须接到传输线的末端。
串联匹配是最常用的终端匹配方法。它的优点是功耗小，不会给驱动器带来额外的直流负载，也不会在信号和地之间引入额外的阻抗，而且只需要一个电阻元件。
常见应用：一般的CMOS、TTL电路的阻抗匹配。USB信号也采样这种方法做阻抗匹配。
b. 并联终端匹配
通过增加并联电阻使负载端输入阻抗与传输线的特征阻抗相匹配，达到消除负载端反射的目的。实现形式分为单电阻和双电阻两种形式。
匹配电阻选择原则：在芯片的输入阻抗很高的情况下，对单电阻形式来说，负载端的并联电阻值必须与传输线的特征阻抗相近或相等；对双电阻形式来说，每个并联电阻值为传输线特征阻抗的两倍。
并联终端匹配优点是简单易行，显而易见的缺点是会带来直流功耗：单电阻方式的直流功耗与信号的占空比紧密相关；双电阻方式则无论信号是高电平还是低电平都有直流功耗，但电流比单电阻方式少一半。

3. PCB阻抗

件Si9000，来计算走线线宽与线间距