DDR(3)DDR3颗粒读写测试

已于 2024-07-29 18:23:33 修改
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分类专栏： FPGA通信接口 文章标签： DDR3 DDR4 MIG IP核 fpga SODIMMs vivado
于 2024-04-30 14:06:21 首次发布
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前言

以四颗MT41K512M16HA-125AIT颗粒为例，介绍如何在一块新制板卡上做关于DDR3的器件测试。前面两篇介绍了什么是DDR，并介绍了xilinx给出的FPGA与DDR完美结合的方案MIG IP核,请按照顺序阅读DDR相关文章，链接在文末。DDR3颗粒，DDR3内存条，DDR4颗粒，DDR4内存条都可以与FPGA相连，DDR芯片选型以及链接形式选型与系统对于数据带宽的要求，存储容量的要求，对结构的要求息息相关，同时不同形式不同代DDR对FPGA选型提出了要求，本文介绍DDR3颗粒与FPGA相连，实现读写测试。

1.配套工程简介

提供了两套DDR3颗粒测试工程，工程文件名是DDR3_2PCS800MHz，DDR3_4PCS400MHz，对应2片DDR的800Mhz读写测试，4片DDR的400Hz读写测试。此外还有DDR4颗粒测试工程和DDR3内存条测试工程。两套DDR3颗粒测试工程主控芯片是xilinx xc7k325tffg900-2，颗粒

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