Vivado与FPGA应用
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介绍关于xilinx的FPGA相关应用知识和原理
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道阻且长 行则将至。
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Aurora8B10B IP使用 -05- 收发测试应用示例
本文首先介绍了根据网上博文简单介绍了8B/10B的原理,并根据Aurora IP的相关使用方法,参考IP手册进行设计递增数测试用例,并下板进行实际验证。原创 2022-06-10 12:30:00 · 2361 阅读 · 13 评论 -
Aurora8B10B IP使用 -04- IP例程应用实例
本文主要介绍了关于Aurora8B10B IP官方提供的模板工程的使用,并进行了简要的仿真查看测试结果,确保仿真传输的正确性。原创 2022-06-09 13:00:00 · 1627 阅读 · 0 评论 -
Aurora8B10B IP使用 -03- IP配置应用指南
本文主要针对Aurora 8B/10B IP的配置界面相关配置项进行简要说明和介绍。可以使用 Vivado工具对 Aurora 8B/10B 内核进行定制,以满足各种要求。原创 2022-06-08 13:34:48 · 1992 阅读 · 0 评论 -
Aurora8B10B IP使用 -02- IP功能设计技巧
承接上文,本文主要介绍了关于IP核中一些功能的配置的方法和技巧使用的示例,主要参考了IP手册的第三章内容。原创 2022-06-08 13:30:12 · 1606 阅读 · 0 评论 -
Aurora8B10B IP使用 -01- 简介与端口描述
Aurora 8B/10B 内核支持 AMBA协议、AXI4-Stream 用户接口。 该内核使用 Zynq、Artix-7、Kintex-7 和 Virtex-7 系列、UltraScale和 UltraScale+系列上的高速串行收发器实现 Aurora 8B/10B 协议。Vivado工具可以为具有可配置数据路径宽度的 Aurora 8B/10B 内核生成源代码。 内核可以是单工或全双工的,并具有两个简单的用户界面之一和可选的流量控制。...原创 2022-06-07 13:14:59 · 3419 阅读 · 0 评论 -
FPGA - DDR IP配置
写在前面本文主要对DDR IP核进行相关配置,完成DDR IP核的配置工作。配置步骤点击 IP Catalog,Search 框中输入 memory interface, 查找到相关的DDR的 IP 核。双击 IP 核名称打开 DDR3 SDRAM IP 核调取界面,该界面主要是总结了所选芯片的型号等。 点击next,此可以按照个人喜好定义器件的名称,也可以选择 DDR3 控制器的个数,我们的器件名为默认,控制器的数量为1 个 。点击 Next,进入到如图所示的界面,如果使用的芯片相同,原创 2022-04-30 12:30:00 · 2130 阅读 · 0 评论