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FPGA
文章平均质量分 71
yxiune
好多东西都是之前做过的,都快忘完了,赶紧记录一点,后面再不断补充吧
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十七、基于软核和CAN搭建FPGA在线升级系统设计
基于软核实现Can通信;逻辑实现Flash文件升级原创 2023-03-22 10:31:40 · 806 阅读 · 0 评论 -
十六、基于FPGA的CRC校验设计实现
基于FPGA的CRC校验循环冗余校验原创 2023-02-14 16:38:24 · 3441 阅读 · 3 评论 -
十五、基于FPGA的图像处理算法之直方图均衡(三)
直方图均衡化原创 2023-02-14 15:32:57 · 981 阅读 · 0 评论 -
十五、基于FPGA的图像处理算法之中值滤波(二)
中值滤波原创 2022-10-18 09:37:10 · 2308 阅读 · 0 评论 -
十五、基于FPGA的图像处理算法之放大(一)
图像放大原创 2022-10-17 16:45:52 · 1930 阅读 · 1 评论 -
十四、基于FPGA的SDI协议介绍(二)
基于Xilinx FPGA介绍SDI IP使用,相关SDI协议原创 2022-10-08 09:43:20 · 4993 阅读 · 7 评论 -
十四、基于FPGA的SDI协议介绍(一)
SDI接口协议,本文写了SD-SDI,主要介绍了PAL实现原创 2022-09-23 10:46:34 · 7538 阅读 · 0 评论 -
十三、Xilinx floating-point IP 使用说明
Xilinx float ip原创 2022-07-19 16:58:40 · 2605 阅读 · 2 评论 -
十二、基于FPGA实现slave SelectMAP配置逻辑
slave SelectMAP配置原创 2021-12-17 17:54:31 · 6330 阅读 · 2 评论 -
十一、Xilinx FPGA相关约束,原语,函数使用及问题记录
约束,原语,函数,相关问题记录原创 2021-04-07 18:10:41 · 6149 阅读 · 0 评论 -
十、基于FPGA的PCIE协议介绍(二)
该文介绍Xilinx的 PCIE XMDA核 。基于上文:https://blog.csdn.net/weixin_41838250/article/details/1149194871,Xdma核介绍 1.1 核架构a,XDMA核主要有两个数据功能;一个是可以配置为AXI接口或AXIS流接口的数据解析通道;一个是配置为桥,使用PCIE核功能。另外还有中断。b,核内交互的4个数据通道:DMA:RQ,RC;桥:CQ,CC RQ:通过DMA发送数据通道; ...原创 2021-03-17 13:49:54 · 5415 阅读 · 1 评论 -
十、基于FPGA的PCIE协议介绍(一)
1. PCIe基础知识PCI-Express(peripheral component interconnect express)是一种高速串行计算机扩展总线标准。由英特尔在2001年提出的,旨在替代旧的PCI,PCI-X和AGP总线标准。PCIe 规范对于设备的设计采用分层的结构,有事务层、数据链路层和物理层组成,各层有都分为发送和接收两功能块。发送端:应用程序(设备核A)在事务层形成事务层包(TLP——Transaction Layer Package),储存在发送缓冲器里,等待推向下层。在数据链原创 2021-03-17 11:31:43 · 4660 阅读 · 0 评论 -
九、基于FPGA的SRIO核的使用
1.SRIO核介绍。 SRIO核核带宽支持x1, x2,x4 。速率支持1.25G 2.5G 3.125G 5G 6.25G。主要包括逻辑层,缓冲层,物理层,底层gt模块。架构图如下:原创 2021-03-15 09:53:28 · 6477 阅读 · 4 评论 -
八、基于FPGA的以太网协议介绍(三)
第一文中介绍了以太网的各层协议;链接:https://blog.csdn.net/weixin_41838250/article/details/114686428?spm=1001.2014.3001.5502第二文中对使用的10Gbase-R和MAC使用做了简单描述;链接:https://blog.csdn.net/weixin_41838250/article/details/114691373这里做一个简单的千兆网络设计,使用RMII接口。1,架构设计2 发送端UDP发送模块原创 2021-03-12 14:40:00 · 613 阅读 · 0 评论 -
八、基于FPGA的以太网协议介绍(二)
在上一文中介绍了以太网的各层协议;链接:https://blog.csdn.net/weixin_41838250/article/details/114686428?spm=1001.2014.3001.5502本文主要介绍一下我项目中使用的10G-BASE-R和MAC层的具体应用;因为项目需求,直接组装了MAC数据报;然后传输。1.10G-BASE-R1.1 内部结构:设计使用了Xilinx的 ten_gig_eth_pcs_pma_0 IP实现10G-BASE-R;用户接口..原创 2021-03-12 14:01:55 · 3913 阅读 · 1 评论 -
八、基于FPGA的以太网协议介绍(一)
以太网是一种计算机局域网技术。IEEE组织的IEEE 802.3标准制定了以太网的技术标准,它规定了包括物理层的连线、电子信号和介质访问层协议的内容。以太网的协议层是建立在OSI模型的基础上的,OSI模型,即开放式通信 系统互联参考模型(Open System Interconnection),是国际标准化组织(ISO)提出的一个试图使各种计算机在世界范围内互连为网络的标准框架,简称OSI。主要包括七层,具体如下: (1)、物理层 Physical Layer (2)、数据链路层 ...原创 2021-03-12 11:07:14 · 2893 阅读 · 0 评论 -
七、基于FPGA的Flash控制器设计
根据项目需求,设计一个Flash控制器。以便将完成低速数据的存储。Flash选用了S25FL032。使用单线SPI接口,接线如图:1,Flash S25fl032介绍1.1 IO描述1.2 相关命令介绍1.3主要命令时序介绍1.3.1 READ命令时序(读数据命令,最大支持40MHZ)1.3.2 FAST_READ 命令时序(读数据命令,最大支持104MHZ)1.3.3 READ_ID命令时序(读ID)1.3.4 WREN,WRDI命令时序(写使能或写原创 2021-03-11 18:10:55 · 2854 阅读 · 0 评论 -
六,基于FPGA的高速串行通信GTX知识梳理
对于XILINX,7系列FPGA,关于GTX核对配置见PG168,了解GTX内部结构及更多的知识见ug476。 以7系列XC7k325t-ffg900为例,见各ug476,351页。可看到该芯片共有4个高速bank,分别为115 116 117 118;每个bank又有4组收发模块和两组时钟模块。1,GTX时钟和复位 (1)时钟源: GTX输入参考时钟通过2组时钟模块的任意一组输入.后通过 IBUFDS_GTE2源于得到参考时钟输入给GT模块.。此处有两种...原创 2020-09-24 18:27:31 · 9542 阅读 · 4 评论 -
五,基于FPGA的DDR控制器设计及MIG控制器使用
1,DDR简述 SDRAM:称为动态随机访问存储器,通过电容保存信息。 SDR : 单速率,单端,LVCMOS标准; DDR : 双速率,差分电路,SSTL标准;2,SDRAM控制器设计 (1)上电初始化; (2) 预充电; (3) 读写 操作命令如下,初始化配置行参数说明如下:上电初始化顺序: 预充电: SDRAM为电容模式,如果不进行预充电,随着时间,他内部数据就会丢失,因此...原创 2020-09-24 16:06:55 · 2206 阅读 · 2 评论 -
四,AXI总线协议解析
1,AXI 总线 AXI(Advanced eXtensible Interface)是一种总线协议,该协议是ARM 公司提出的 AMBA(Advanced Microcontroller Bus Architecture)3.0 协议中最重要的部分,是一种面向高性能、高带宽、低延迟的片内总线。它的地址/控制和数据相位是分离的,支持不对齐的数据传输,同时在突发传输中,只需要首地址,同时分离的读写数据通道、并支持显著传输访问和乱序访问,并更加容易就行时序收敛。AXI 是 AMBA 中一个新的...原创 2020-09-24 14:38:30 · 3487 阅读 · 0 评论 -
三,基于FPGA的IIC主机与从机通用编程设计
1,IIC协议 IIC,即Inter-Integrated Circuit(集成电路总线),这种总线类型是由飞利浦半导体公司在八十年代设计出来的一种简单、双向、二线制、同步串行总线。是当今电子设计中应用最为广泛的串行总线之一。在很多领域有着广泛的应用,如存储器、LED及LCD驱动器、AD/DA转换器、传感器、图像处理领域的摄像头配置(SCCB)等等。 IIC是一种多向控制总线,也就是说多个IIC设备可以连接到同一总线结构下,每个连接到总线的设备都具有唯一的地址,主机可以做为发送器...原创 2020-09-24 13:39:16 · 2970 阅读 · 1 评论 -
二,基于FPGA的串口UART通用编程设计
1,串口通信 异步通信的主要通讯方式,一根数据线即可完成传输,通过约定速率实现数据串并解析,按位顺序进行传输。通过电气标准分为RS-232,RS-422,RS-485。2,串口通信时时序一次串口传输主要有4类数据传输,具体如图所示. 空闲位 : 持续的高电平为空闲位 起始位 :1个低电平表示起始位 数据位 : 数据位一般有8位,一次传输一个字节的数据,从低到高以此传输。 校验位 : 校验位可配置为奇校验,偶校验,无效验。...原创 2020-09-24 13:11:10 · 703 阅读 · 1 评论 -
一,FPGA配置及文件生成烧写
1,硬件相关配置 以7系列为例,主要参考ug470。 (1) 主要配置模式如下图,最常用的应为Master SPI 为001 (2)相关pin介绍如下: CFGBVS :主要用于配置bank0的电压选择。如果bank0接2.5V或3.3V,则CFGBVS和bank0一样接.2.5V或3.3V。如果bank0接0v到1.8V,则CFGBVS接GND。 M[2:0] : 根据上图配置模式配置,需要说明的是如果串联电阻,电阻值小于等...原创 2020-09-24 11:51:08 · 2940 阅读 · 0 评论