注:无需移植跳转至生成比特流步骤即可。
一、IP移植
工程所用IP不涉及PS端arm内核,均在PL端,皆可移植至ZCU102。在vivado新建工程中设置好导出xci文件拷贝至对应文件夹(新增zcu102文件夹)即可,脚本运行时会自动添加对应ip
所使用PL端IP为:
DDR4控制器(拷贝位置piton/design/chipset/mc/xilinx/zcu102/ip_cores/ddr4_0)
![](https://img-blog.csdnimg.cn/img_convert/7298f7ceb207842bf540df7d9e4b0518.png)
UART16550串口(拷贝位置/piton/design/chipset/io_ctrl/xilinx/zcu102/ip_cores/uart_16550
![](https://img-blog.csdnimg.cn/img_convert/f91dc1d2ebb0dc14d6f0660dc5be9dc5.png)
afifo_w64_d128(拷贝位置piton/design/chipset/Xilinx/zcu102/ip_cores/afifo_w64_d128_std)
![](https://img-blog.csdnimg.cn/img_convert/8342a67cd94531e9eb0351eb026cfad7.png)
![](https://img-blog.csdnimg.cn/img_convert/8dd3f0dfd207bcfc057e7db94d9a6f88.png)
![](https://img-blog.csdnimg.cn/img_convert/01a201b1a2c45b9809bd383c20640477.png)
![](https://img-blog.csdnimg.cn/img_convert/48e3166eb1e35d7ec46a1de234fc4eca.png)
clk_mmcm时钟分频(拷贝位置/piton/design/chipset/xilinx/zcu102/ip_cores/clk_mmcm)
![](https://img-blog.csdnimg.cn/img_convert/d85bea62af864e1989123af1f3b4c33b.png)
![](https://img-blog.csdnimg.cn/img_convert/3fbe8bbd14024d7bc455aeeea9db5645.png)
atg_uart_init串口初始化(拷贝位置piton/design/chipset/io_ctrl/xilinx/zcu102/ip_cores/atg_uart_init)
![](https://img-blog.csdnimg.cn/img_convert/0d5e373d8acf88138bee69b997cfd447.png)