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电子废材＼(`Δ’)／

已于 2023-05-09 16:32:07 修改

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分类专栏： FPGA学习文章标签： fpga开发经验分享

于 2023-04-20 22:24:24 首次发布

本文链接：https://blog.csdn.net/weixin_50456539/article/details/130276689

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在FPGA项目中，开发者通常会基于例程进行开发，但遇到IO配置和IP核设置的困扰。文章讲述了作者因误操作导致Xilinx设计初始化过程卡住的问题，通过删除xdc文件并清理后台进程解决。作者建议直接使用xdc文件设置约束，并警告避免通过Implementation分配IO。

摘要由CSDN通过智能技术生成

之前做FPGA项目的时候基本都是把例程代码全部删除然后完成自己的代码（保留IP 、IO 、顶层等文件，只用DDR4相关接口以及相关按键），但是怎么配置IO我也不知道，本想着一步一步来，但是内部有一些IP核设置过于麻烦老师也建议直接在例程写就行，事实证明我导是对的，后期建立了很多工程，这要是一个个IP的建立以及分配996个IO得累死人虽然可以直接利用xdc文件。
现在需要系统学习一下，大概就是从0

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- - Xilinx一直显示Running Design lnitialization

Xilinx一直显示Running Design lnitialization

今天在执行lmplementation进行IO planning时误操作产生了两个xdc文件，本想着删除了一个吧，结果后续lmplementation一直显示Running Design lnitialization，一直没解决后续重新建立了一个工程解决了，但是不能把问题搁置，于是暴露出第一个问题：请添加图片描述
没有将xdc文件设置为Target Constraint File文件，本来以为设置了就OK了，但是还是一直显示Running Design lnitialization，于是查找了一番，发现需要打开任务管理器在后台进程里清除vivado.exe进程再删除impl_1文件夹，删除后重启xilinx成功，。请添加图片描述
具体原因我也不是很清楚，之前有问题时尝试删除该文件夹显示一直被占用，估计是一直被占用的问题，建议就是不要通过运行lmplementation分配IO，直接添加xdc后设置为Target。