电路基础知识——常见晶振电路

一、有源晶振

有源晶振的精度则可以达到0.1ppm。精度越高,频率稳定性也更好。有源晶振在稳定性上要胜过无源晶振。有源晶振一般4个脚,一个电源,一个接地,一个信号输出端,一个NC(空脚)。有源晶振自身就能震动。

注: R1、C3需根据实际进行调整处理,电源必须是稳压的且电源引线尽量短,并尽量与系统中使用晶振信号的芯片共地。

二、无源晶振

无源晶振有2个引脚,需要借助于外部的时钟电路(接到主IC内部的震荡电路)才能产生振荡信号,自身无法振荡。两个外接电容能够微调晶振产生的时钟频率。

1、晶振负载电容选择

不同公司生产的同一标称频率的晶振,所需要的负载电容CL(Load capacitance)可能不同。通过公式计算电容容值

某晶振数据
某公司晶振数据

晶振外部负载电容计算C_{e}

C_{e}=2\times C_{L}-\left ( C_{s}+C_{i} \right )

C_{L}为晶振容性负载,可通过查阅晶振数据手册获取

C_{s}为PCB走线电容,可通过查询芯片数据手册获取

C_{i}为芯片引脚寄生电容,可通过查询芯片数据手册获取,在3-6pF之间

例子:假设晶振为晶振容性负载C_{L}=0pF,走线线电容C_{s}=2.8pF,引脚电容C_{i}=6pF,则晶振外部负载电容C_{e1}=C_{e2}=2\times 20pF-\left ( 2.8pF+6pF \right )=31.2pF,因此晶振外围电容容值选择33pF。

3、晶振并联一个1M电阻(KHz晶振电路,并联电阻通常为10M欧,MHz晶振,并联电容通常为1M欧左右)

并联电阻的作用: 
1.降低晶体的Q值,Q值降低后晶体起振比较容易。

2.抑制EMI,EMI不过时,可减小阻值。

3.提供直流工作点。

4.使门电路工作于线性区,并联1M电阻增加了电路中的负性阻抗(-R),即提升了增益,缩短了晶振起振时间,达到了晶振起振更容易之目的。

5.在低温环境下振荡电路阻抗也会发生变化,当阻抗增加到一定程度时,晶振就会发生起振困难或不起振现象给晶振并联1MΩ电阻,增加振荡电路稳定性。

注:并联电阻不能太小,串联电阻不能太大。否则,在温度较低的情况下不易起振。

4、串联电阻

串联电阻的作用:

1.降低晶体的激励功率,防止损坏。

2.限制振荡幅度。

3、给晶振同时串联一个100Ω的电阻,减少晶振的频率偏移程度。

三、晶振选型关键参数

1、基准频率:晶振在完全理想条件下的振荡频率。

2、工作电压:晶振的工作需要外界提供一定的电源电压,晶振输出的时钟信号上的噪声与电源噪声紧密相关,因此在晶振器件资料上,对电源的质量有一定的要求。

3、输出电平:信号电平种类有许多种,时钟信号的电平也多种多样。在选型中,应根据所需时钟电平的种类,选择对应的晶振。

4、工作温度范围:根据环境温度要求的不同,应选择对应的工作温度范围。

5、频率精度:对应不同的工作温度范围,可选择不同的频率精度。参数是晶振最重要的参数,包含了由于温度变化、电源电压波动、负载变化等因素引起的频率偏差。

6、老化度:在恒定的外界条件下测量晶振频率,频率精度与时间之间的关系。

7、启动时间:从上电到晶振输出频率的偏差达到规定的频率精度所需要的时间。

四、晶振分类

晶振的分类常用的晶振分为三类:标准封装晶体振荡器SPXO、压控式晶体振荡器VCXO、温度补偿式晶体振荡器TCXO。

(1)标准封装晶体振荡器SPXO

无温度补偿功能,也无电压控制功能,其频率特性完全取决于晶体以及外部振荡电路,频率精度最高可以达到士10ppm,是晶振中精度最差的一个种类。

主要参数

1、基准频率:多种频率可供选择。

2、工作电压:支持1.8V、2.5V、3.3V、5.0V。

3、输出电平:输出时钟信号电平为CMOS。

4、工作温度范围:SPXO不具备温度补偿功能,因此在PCB布局时,SPXO器件应远离发热源。

5、频率精度:频率精度已完全包括了温度变化、电源电压波动、老化等因素引起的频率偏差。

6、老化度:由于老化对晶振精度的影响已经包含在频率精度中。

7、启动时间:最大值为10ms。

8、占空比:在双边沿采样的时序计算中,应考虑占空比参数。

9、时钟抖动(Jitter):两个抖动参数:一个是RMS Jitter(12kHz~20MHz),典型值为0.5ps;另一个是RMS Jitter(全频段),典型值为2.5ps。

(2)压控式晶体振荡器VCXO

VCXO常用在锁相环(PLL,Phase-Locked Loop)电路中。

主要参数:

1、基准频率:从77.76MHz开始,最高可达200MHz,在这个区间中有多种频率可供选择。

2、输出电平:输出时钟信号的电平为LVPECL。

3、工作温度范围:根据环境温度要求的不同,应选择对应的工作温度范围。

4、频率--温度稳定度:±20ppm,表示在工作温度范围内,频率偏移的最大值。VCXO不具备温度补偿功能,因此在PCB布局时,VCXO器件应远离发热源。

5、电源电压:3.3V,这是VCXO的工作电压。

6、控制电压:调整范围为0.3~3V,除了电源电压外,VCXO还需要控制电压,以调节输出频率。

7、牵引范围(Pull Range):从中央电压开始,将调整电压向最小值或最大值的方向调整时,输出频率的变化范围。

8、绝对牵引范围(Absolute Pull Range):绝对牵引范围=牵引范围(由于温度变化、老化、电源波动、负载变化造成的偏移范围),在根据芯片所要求的频率偏移最大量选型VCXO时,应参考绝对牵引范围,而不是牵引范围。

9、频偏敏感度:在牵引范围一调整电压曲线图中,“Gain”曲线代表频偏敏感度。以ppmV为单位。

10、线性度:指“Gain”曲线的线性程度。该参数值越小越好。一般而言,VCXO的牵引范围越宽,线性度越差。

11、调制带宽:VCXO能支持的调整电压最大带宽。

12、时钟抖动:四个抖动参数,一是RMS Jitter(12kHz20MHz),典型值为0.3ps;二是RMS Jitter(50kHz80MHz),典型值为0.5ps;三是RMS Jitter(全带宽),典型值为3ps;四是Jitter.蜂-蜂值,典型值为20ps.

(3)温度补偿式晶体振荡器TCXO

TCXO是利用附加的温度补偿电路以减小环境温度对振荡频率影响的一种晶体振荡器。其特点是:频率精度远远高于SPXO和VCXO。
 

主要参数:

1、基准频率:最高可达27MHz,有多种频率可供选择。

2、输出电平:输出时钟信号电平为CMOS。

3、工作温度范围:根据环境温度要求的不同,应选择对应的工作温度范围。

4、电源电压:3.3V或5V。

5、控制电压:TCXO提供一个引脚作为控制电压的输入,以实现类似于VCXO利用控制电压调整输出频率的功能,当不使用该功能时,应将此引脚接地。

6、启动时间:最大值为2ms。

7、相位噪声:

8、频率精度:频率精度参数已完全包括了温度变化、电源电压波动、老化等因素引起的频率偏差。根据芯片对时钟精度的要求,对TCXO选型时,这是最重要的一项参数。

五、PCB设计注意事项

一是为了保持负载电容的恒定。晶振的两个焊盘与其下方的平面层之间会形成寄生电容,这个电容会影响晶振的频偏,导致系统工作不正常。为了减小寄生电容,需要在晶振下方的平面层做挖空处理,使得焊盘到平面的距离增大。


二是为了抑制热传导导致的频偏。晶振的频率会受到温度的影响,如果周围有发热的器件,会通过铜皮传导到晶振,造成频偏。为了隔绝热传导,需要在晶振下方的平面层做挖空处理,使得晶振与发热器件之间没有铜皮连接

### 无源晶振电路中匹配电容的选择与作用 #### 匹配电容的作用 在无源晶振电路中,匹配电容的主要功能是在特定的工作条件下使晶振达到最佳性能。这些电容器帮助调整负载电容(Load Capacitance),从而影响振荡频率及其稳定性。具体而言: - **调节振荡频率**:增加负载电容通常会导致振荡频率降低,反之则提高频率[^2]。 - **提升频率稳定性**:合适的匹配电容能够减少环境变化对振荡频率的影响,增强系统的可靠性。 #### 如何选择匹配电容 为了正确选择匹配电容,应遵循以下原则: 1. **查阅器件资料**:确认所使用的晶振的具体参数,特别是其指定的负载电容值(CL),这可以从制造商提供的数据表获得[^1]。 2. **考虑杂散电容(Cs)**:实际应用中的PCB布局和其他元件可能会引入额外的小量电容,称为杂散电容。这部分也需要纳入总的有效负载电容计算之中。一般认为这个数值大约介于2到7 pF之间[^5]. 3. **利用经验公式估算**:基于上述信息以及已知的CL和Cs,可以通过简单的数学关系式来初步设定匹配电容CL1和CL2的大小。例如,在某些情况下适用的经验公式为\[ CL_1 \times CL_2 / (CL_1 + CL_2) = (CL + Cs)/2\]. 4. **确保合理的分布**:如果存在两个不同的匹配电容,则建议输入侧的容量应当略低于输出侧,以维持良好的信号传输特性[^4]. ```python def calculate_matching_capacitors(load_capacitance, stray_capacitance): """ 计算匹配电容CL1和CL2 参数: load_capacitance (float): 负载电容值(pF) stray_capacitance (float): 杂散电容值(pF) 返回: tuple: 包含两个浮点数,分别为CL1和CL2的推荐值 """ total_effective_load = (load_capacitance + stray_capacitance) / 2 cl1_cl2_product = pow(total_effective_load * 2, 2) # 假设理想状态下CL1等于CL2 matching_caps = math.sqrt(cl1_cl2_product), math.sqrt(cl1_cl2_product) return matching_caps ```
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