spi配置AD9528

淋青

于 2024-02-23 15:09:15 发布

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分类专栏： FPGA 文章标签： fpga

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本文介绍了AD9528芯片的时序图，涉及数据寄存、地址配置、读写控制，重点讲解了如何通过上位机软件修改时钟输入、参考时钟和PLL分频系数以实现不同输出时钟频率。作者分享个人学习体验，欢迎提出纠正意见。

摘要由CSDN通过智能技术生成

一、引言

本文为个人理解，用于记录学习经验，有任何错误可以指出讨论。

二、AD9528

时序图

该字节长度最小为24bit

0-7bit : D0~D7为寄存数据；

8-23bit : A0~A14为地址位，R/W是读写控制位

寄存器配置可以通过ADI公司的上位机软件生成

修改添加Clock In（VCXO）、RefA/RefB、SysRef参考时钟，以及修改PLL1和PLL2的分频系数，得到需要的输出时钟频率。

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spi配置AD9528

修改添加Clock In（VCXO）、RefA/RefB、SysRef参考时钟，以及修改PLL1和PLL2的分频系数，得到需要的输出时钟频率。本文为个人理解，用于记录学习经验，有任何错误可以指出讨论。8-23bit : A0~A14为地址位，R/W是读写控制位。0-7bit : D0~D7为寄存数据；寄存器配置可以通过ADI公司的。该字节长度最小为24bit。
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