xilinx中的双端口RAM与Altera中的不同与使用

最新推荐文章于 2024-05-04 14:58:40 发布
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分类专栏： FPGA 文章标签： verilog
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版权

一、端口不同

1、对于xilinx来说：

clka  为输入端口的时钟
wea  读写控制端，高为写，低为读
addra 写地址
dina  待写入的数据
clkb 为输出端口的时钟的
addrb 读地址
doutb 读出的数据

ena/enb，控制相应写入和读出端口的数据，为高是正常写入或读出，为低时写入为0，读出为0

2、对于altera来说

 

youzjuer
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