FPGA挂载NVME SSD（一）

最新推荐文章于 2025-09-16 15:16:08 发布
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#FPGA #NVME #SSD

GA挂载SATA SSD需要SATA IP，IP报价动辄十几W，开源的IP也有，但都是基于V6或者V5等老器件的。现在好了，NVME SSD大行其道，而且不需要IP，可以说为广大爱好者带来的福音。国外的FPGA大牛Jeff Johnson写了一个FPGA挂载NVME SSD的教程http://www.fpgadeveloper.com/2016/04/zynq-pci-express-root-complex-design-in-vivado.html，并提供了完整的工程，支持XILINX的大部分7系列及最新的UltraScale系列。
在这里插入图片描述

  1. 下载完整的工程fpga-drive-aximm-pcie-2017.2.zip
  2. 解压并打开/Vivado目录，根据所用的开发板，运行相应的.bat文件创建工程，例如，我用的是ZC706且通过FMC HPC扩展子卡挂载SSD，则点击build-zc706-hpc.bat
  3. 打开生成的工程，生成bitstream，export并打开SDK
  4. 在SDK中创建工程，并将/SDK/common目录下的pcie_gen2_enumerate.c添加到工程中
  5. 搭建硬件环境
  6. 下载bitstream，并运行
  7. 串口显示如下：
    在这里插入图片描述
    由串口打印可知，SSD已LINK成功。
ZYNQ petalinux中PCIE读写NVME固态硬盘
wangjie36的博客
08-21 1万+
调用AXI Memory Mapped To PCI Express IP核，对7 Series Integrated Block for PCI Express进一步封装，使用Example Design直接运行，但需要添加DMA IP核实现DMA数据传输。 PCIE采用了全双工的传输设计，即允许在同一时刻，同时进行发送和接收数据。如下图所示，设备A和设备B之间通过双向的Link相连接，每个Link支持1到32个通道（Lane）。由于是串行总线，因此所有的数据（包括配置信息等）都是以数据包为单位进行发送的
基于 FPGA 的固态硬盘存储控制器设计--笔记
weixin_60354142的博客
03-02 3904
本文完成了以 FPGA 为主控、无 CPU 的固态硬盘存储控制器设计，可实现FPGA 对 PCIe SSD 的直接数据读写控制。该存储控制器由 PCIe Root Complex、PCIe 控制逻辑和 NVMe 控制模块组成，其中 PCIe Root Complex 模块为 Xilinx公司的 IP 核，本文在其基础上完成了用于配置 PCIe 配置空间和发送 TLP 报文的相关控制逻辑，以实现 RC 和 EP 两端的数据通信；NVMe 控制模块为本文依据 NVMe 协议设计的核心控制模块，其主要实现了 NV
zynq下pcie nvme硬盘接口实现
04-19
zynq7035下pcie nvme硬盘接口实现，包括硬件设计软件设计，用于各种工程项目，放心使用（已工程验证）。
FPGA硬件设计6 ZYNQ外围-HDMI、PCIE、SFP、SATA、FMC
最新发布
陌夏微秋的博客
09-16 1187
介绍了HDMI PCIE SFP SATA FMC等方面的硬件与相关知识
FPGA实现高带宽NVMeSSD读写——纯逻辑实现
weixin_42166371的博客
08-13 6638
使用FPGA纯逻辑实现NVME Host ，IP读盘速度最高为3125MB／s，写速度最高为2960MB/s，整体性能不低于3125MB/s
基于FPGA的双盘NVMe SSD的RAID0模式读写实现及测试
weixin_42166371的博客
03-12 7060
本文将介绍基于XCZU7EG芯片的双盘NVMe SSD RAID0读写的实现以及性能测试。写入性能约为单盘1.8~1.9倍，读出性能约为单盘1.4~1.5倍。
基于FPGA纯逻辑的双盘NVMe RAID0存储系统
weixin_42166371的博客
10-20 2384
本系统使用FPGA纯逻辑的方式实现了双路NVME SSD的RAID0读写。在PCIe3.0标准下，双路NVME系统读盘速度最大可达6.1GB/s,写盘速度最大可达5.9GB/s，系统效率最大可达99%，并能保持在97%以上。
ZCU102基于Petalinux挂载NVMe SSD
kkioss的博客
06-24 5142
环境说明： 1. Ubuntu 系统 18.04.4 2. 开发环境三贱客：Vivado 2020.2 + Petalinux 2020.2 + Vitis 2020.2 3. 开发板： Xilinx ZCU102 4. SSD: PCIe - M.2转接板 + 三星 SSD 980 500GB 一、Vivado工程准备 首先第一步需要在Vivado中建立ZCU102的PCIe Root Complex控制...
运行在PETALINUX上FPGA与SSD连接方案验证测试说明v1.0.docx
11-18
基于FPGA大牛Jeff Johnson写了一个FPGA挂载NVME SSD的教程http://www.fpgadeveloper.com/2016/04/zynq-pci-express-root-complex-design-in-vivado.html，关于在petalinux上运行fpga并与ssd连接整理的详细文档
基于 FPGA 的 NVMe 接口设计--笔记
weixin_60354142的博客
02-25 2349
总线是计算机系统中从设备与总线控制器之间交换数据的通道。扩展总线是由PC机中发展出的概念，指的是连接PC系统中的CPU与插在扩展槽上的外设之间的总线。PCI Express就是一种扩展总线，但由于其高速低延迟的高性能，及良好的扩展性，PCI Express在嵌入式系统中也获得了广泛的应用。 但PCI总线作为一种多设备共用的并行总线，其先天的劣势是： 1) 并行信号带来的信号完整性问题，以及共用信号线带来的驱动能力问题，这都使得总线频率难以提升。 2) 共用信号线的形式使得外设增...
linux系统上提供读写nvme ssd的接口
04-12
另外，引用[1]提到在FPGA项目中，通过修改Linux的NVMe驱动来适配硬件，说明驱动开发可能涉及内核模块的修改。但普通用户可能只需要使用现有的驱动，不需要深入修改。用户如果要做性能优化或者问题排查，可能需要了解...
FPGA实现高带宽NVMe SSD读写
热门推荐
weixin_42166371的博客
06-17 1万+
本文中的项目采用软硬协同实现NVMe协议，并基于Zynq UltraScale+系列XCZU7EV FPGA芯片实现高带宽NVMe SSD读写。写入速度稳定2.3GB/s，读取速度稳定2.5GB/s。
FPGA NVME SSD
sea
11-13 2164
FPGA NVME SSD
FPGA NVMe SSD SQ
sea
09-20 794
FPGA NVMe SSD
FPGA NVME高速存储设计
Herok
06-22 2481
690T高速存储硬件设计框图如下，switch下面挂载6张ssd，一路x8 到fpga host，1路x8到fpga ep，pcie端采用nvme ip实现ssd盘的读写，40Gbps以太网数据，以及多通道的srio和GTX数据，整个架构中最核心的就是nvme ip，nvme ip扮演了大脑的角色，负责枚举ssd，分配地址，以及nvme协议处理等。关于nvme ip资源消耗情况，目前整个高速存储使用的资源如下，其实代码中有个细节可以优化很多bram接口，因为前期设计考虑冗余了，导致资源消耗过多。
基于FMC架构的FPGA NVMe标准文件存储模块
lianchen216的专栏
12-31 1052
基于高性能FPGA与NVMe先进存储架构，研发了一款FMC架构的存储模块，可将该模块集成到客户接口板卡或单独外界扩展接口使用。 通过FPGA提供高速的接收接口，支持SRIO，AURORA，40G等高速协议，内部通过FPGA实现标准文件系统，2块NVMe存储盘，支持RAID0，带宽不低于4GB/s，可应用于特定高速接收存储的场景。 规格 内容 产品形态 单宽度FMC子卡 存...
FPGA 纯逻辑NVME测试
RFSOC的博客
06-11 1408
NVMe IP支持3种命令,包括Identify、Write、Read逻辑提供2组接口分别为app_c*和app_s*，app_c*用来传输用户定义的NVMe命令并提供反压机制，app_s*用来传输用户读写数据，NVMe IP内部实例化256KB的真双口RAM作为数据缓存，用户通过app_c*接口操作的粒度固定为1MB。使用Xilinx Integretd Block For PCIe硬核，工作在Gen1、Gen2、Gen3、X4模式。自定义app_c*、app_s*接口方便用户操作。
基于FPGA的NVMe 存储架构
lianchen216的专栏
11-09 2258
NVMe存储板卡，FPGA
FPGA 纯逻辑NVME IP 核
jingjiankai5228的博客
01-09 2429
随着存储速度需求越来越大，SATA的读写速度很多场景就有点吃力了，基于PCIE协议的NVME协议慢慢成为主流厂商的首选，FPGA实现NVME协议是比较复杂的，本文主要基于xilinx的方案，前面说了NVME协议主要基于PCIE协议，XILINX本身就有XDMA这种封装比较好的IP，无形中就大大降低了NVME协议的实现，将XDMA配置为ROOT模式，简单点的方式就是通过ZYNQ这类器件直接控制XDMA实现CQ SQ管理，这种方案相对比较简单，但是灵活性相对较差，另外一种方式就是直接通过HDL管理初始化 CQ
#FPGA NVME SSD
05-17
### FPGA NVMe SSD 实现方案概述 FPGA在实现高性能NVMe SSD读写方面具有显著优势，尤其是在定制化需求和实时处理场景中。以下是关于如何利用FPGA实现高效NVMe SSD的技术细节。 #### 架构设计 为了实现高效的NVMe SSD操作，通常需要将FPGA配置为Root Complex (RC)，从而能够主动管理和控制作为Endpoint (EP) 的NVMe SSD设备[^2]。这种架构允许FPGA通过PCIe总线直接访问SSD的寄存器和存储区域，减少中间环节带来的延迟。 #### 协议支持 NVMe协议栈的解析是整个设计的核心部分之一。具体来说，需要基于Xilinx AXI PCIe IP核构建Root Port架构，并完成以下功能模块的设计： - **BAR 寄存器组映射**：定义并初始化PCIe配置空间中的基址寄存器(BARs)[^2]。 - **队列管理**：按照NVMe标准实现提交队列(SQ) 和完成队列(CQ)，并通过门铃寄存器通知SSD执行命令或返回结果[^2]。 #### 性能优化策略 尽管现有方案已经实现了较高的吞吐量(如ZCU106平台上可达2.3GB/s写入, 2.5GB/s读取)[^1]，但仍可通过改进逻辑结构进一步提升效率至接近理论极限值约3.94GB/s(Gen3 x4链路条件下的最大传输速率)[^3]: - 使用更先进的工艺节点制造芯片以降低功耗并增加可用资源数量； - 对内部数据路径进行全面流水线改造，消除潜在瓶颈； - 增强错误检测与纠正能力(ECM), 提升可靠性的同时也间接促进了整体表现改善。 #### 硬件选型考量因素 当选择合适的FPGA型号时应考虑以下几个关键要素: - 是否内置强大的MCU/CPU单元以便简化软件开发流程; - 支持高速串行通信接口的能力，优先选用具备集成PHY硬核的产品; - 可编程逻辑单元的数量充足用于部署复杂的计算密集型任务. 综上所述,Xilinx Zynq系列产品因其兼具ARM处理器子系统以及丰富的可重构硬件资源而成为理想候选者之一[^4]. ```python def fpga_nvme_performance(): theoretical_max_gen3 = 3.938 # GB/s for PCIe Gen3 x4 lanes zcu106_write_speed = 2.3 # GB/s achieved on ZCU106 platform with custom design zcu106_read_speed = 2.5 # GB/s improvement_potential = ((theoretical_max_gen3 - max(zcu106_write_speed,zcu106_read_speed)) / min(zcu106_write_speed,zcu106_read_speed))*100 return {"Theoretical Max Speed":theoretical_max_gen3,"Current Write Speed(ZCU106)":zcu106_write_speed, "Current Read Speed(ZCU106)":zcu106_read_speed,"% Improvement Potential":improvement_potential} fpga_perf_metrics=fpga_nvme_performance() print(f"FPGA Performance Metrics:\n{fpga_perf_metrics}") ```
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