System Generator 中 Divider Generator 5.1 && DSP48 error 问题

最新推荐文章于 2022-07-05 23:44:41 发布

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分类专栏： System Generator matlab 文章标签： matlab System Generator Simulink Xilinx Vivado

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当我们使用 Xilinx 14.7 和 Vivado 2013.4 以及 MATLAB 2013a 编译环境，利用 Sysytem Generator 里 Divider Generator 、 DSP48 进行建模时候，运行仿真可能会遇到如下错误： "ERROR: [Ipptcl 7-5] XIT evaluation error: Invalid file name: c:/Use

摘要由CSDN通过智能技术生成

当我们使用 Xilinx 14.7 和 Vivado 2013.4 以及 MATLAB 2013a 编译环境，利用 Sysytem Generator 里 Divider Generator 、 DSP48 进行建模时候，运行仿真可能会遇到如下错误：

"ERROR: [Ipptcl 7-5] XIT evaluation error: Invalid file name:

c:/Users//AppData/Local/Temp/xlsim5304f571/hdl_netlist/xelab.srcs/sources_1/ip/div_gen_v5_1_1/div_gen_v5_1_1_ooc.xdc"

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System Generator 中 Divider Generator 5.1 && DSP48 error 问题

当我们使用 Xilinx 14.7 和 Vivado 2013.4 以及 MATLAB 2013a 编译环境，利用 Sysytem Generator 里 Divider Generator 、 DSP48 进行建模时候，运行仿真可能会遇到如下错误： "ERROR: [Ipptcl 7-5] XIT evaluation error: Invalid file name: c:/Use
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